1.本实例用于控制开发板上面的SDRAM完成读写功能；
先向SDRAM里面写数据，然后再将数据读出来做比较，如果不婚配就通过LED变亮显示出来，如果一致，LED就不亮。
2.part1目录是使用Modelsim仿真的工程；
3.part2目录是在开发版上面验证的工程；
2.1.part1_32目录是4m32SDRAM的仿真工程；
2.2.part1_16目录是4m16SDRAM的仿真工程；
\model文件夹里面是仿真模型；
\rtl文件夹里面是源文件；
\sim文件夹里面是仿真工程；
\test_bench文件夹里面是测试文件；
\wave文件夹里面是仿真波形。
3.1.工程在\project文件夹里面;3.2.源文件和管脚分配在\rtl文件夹里面;3.3.下载文件在\download文件夹里面,.mcs为PROM模式下载文件,.bit为JTAG调试下载文件。
先向SDRAM里面写数据，然后再将数据读出来做比较，如果不婚配就通过LED变亮显示出来，如果一致，LED就不亮。
2.part1目录是使用Modelsim仿真的工程；
3.part2目录是在开发版上面验证的工程；
2.1.part1_32目录是4m32SDRAM的仿真工程；
2.2.part1_16目录是4m16SDRAM的仿真工程；
\model文件夹里面是仿真模型；
\rtl文件夹里面是源文件；
\sim文件夹里面是仿真工程；
\test_bench文件夹里面是测试文件；
\wave文件夹里面是仿真波形。
3.1.工程在\project文件夹里面;3.2.源文件和管脚分配在\rtl文件夹里面;3.3.下载文件在\download文件夹里面,.mcs为PROM模式下载文件,.bit为JTAG调试下载文件。
2022/9/3 1:26:12
2.07MB
1
modelsim-win64-10.6d-se，2018最新SE版，千辛万苦从外网搬运过来的，付破解方法（其实是和以前的版本一样的破解方法）亲测完满兼容vivado2017.3，希望能物尽其用
2017/7/7 6:57:57
64B
1
为了克服基于传统查表法实现DDS方法占用存储单元多、运算速度和精度较低等缺陷，重点研究并实现了基于CORDIC算法的线性调频信号产生方法。
采用Verilog硬件描述言语设计实现了基于CORDIC算法的流水线式直接数字合成器(DDS)，结合线性调频信号的相位调制函数，实现了线性调频信号的硬件产生。
ModelSim上RTL仿真结果验证了该方法的正确性。
采用Verilog硬件描述言语设计实现了基于CORDIC算法的流水线式直接数字合成器(DDS)，结合线性调频信号的相位调制函数，实现了线性调频信号的硬件产生。
ModelSim上RTL仿真结果验证了该方法的正确性。
2018/8/25 3:30:45
863KB
1
在工程中:keccak.v为顶层文件，分别调用下面几个文件，f_permutation.v、padder1.v、rconst2in1.v、round2in1.v、padder1.v。
test_keccak.v为仿真代码。
在仿真代码test_keccak.v中，仿真控制输入，reg[63:0]in;为输入，wire[511:0]out;为输出端。
在仿真代码中通过对输入的参数进行控制，实现对算法输入控制的变化，通过仿真波形图来观察输出端。
————————————————版权声明：本文为CSDN博主「QQ_778132974」的原创文章，遵照CC4.0BY-SA版权协议，转载请附上原文出处链接及本声明。
原文链接：https://blog.csdn.net/QQ_778132974/article/details/124217676
test_keccak.v为仿真代码。
在仿真代码test_keccak.v中，仿真控制输入，reg[63:0]in;为输入，wire[511:0]out;为输出端。
在仿真代码中通过对输入的参数进行控制，实现对算法输入控制的变化，通过仿真波形图来观察输出端。
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2018/10/19 12:45:57
2.28MB
1
开源骚客SDRAM第一季功能仿真代码，本人跟着视频敲得1.代码风格比较好2.包括串口收发、sdram初始化模块、仲裁模块、读写模块等3.所有代码按照课程进度来写的，适合一步步了解sdram功能及各模块时序要求4.全都完成modelsim功能仿真
2019/9/9 14:33:51
17.03MB
1
本破解还是根据之前网络上流传的其他版本摸索着破解的，在我的电脑上modelsim10.1awin732，曾经经过验证成功
2020/2/25 23:28:57
511KB
1
Modelsimse是一款专业的HDL语言仿真软件，它能提供友好的仿真环境，是业界独一的单内核支持VHDL和Verilog混合仿真的仿真器。
它采用直接优化的编译技术、Tcl/Tk技术、和单一内核仿真技术，编译仿真速度快，编译的代码与平台无关，便于保护IP核，个性化的图形界面和用户接口，为用户加快调错提供强有力的手段，是FPGA/ASIC设计的首选仿真软件。
它采用直接优化的编译技术、Tcl/Tk技术、和单一内核仿真技术，编译仿真速度快，编译的代码与平台无关，便于保护IP核，个性化的图形界面和用户接口，为用户加快调错提供强有力的手段，是FPGA/ASIC设计的首选仿真软件。
2016/11/14 22:10:26
500.68MB
1
在日常工作中，钉钉打卡成了我生活中不可或缺的一部分。然而，有时候这个看似简单的任务却给我带来了不少烦恼。
每天早晚，我总是得牢记打开钉钉应用，点击"工作台"，再找到"考勤打卡"进行签到。有时候因为工作忙碌，会忘记打卡，导致考勤异常，影响当月的工作评价。而且，由于我使用的是苹果手机，有时候系统更新后，钉钉的某些功能会出现异常，使得打卡变得更加麻烦。
另外，我的家人使用的是安卓手机，他们也经常抱怨钉钉打卡的繁琐。尤其是对于那些不太熟悉手机操作的长辈来说，每次打卡都是一次挑战。他们总是担心自己会操作失误，导致打卡失败。
为了解决这些烦恼，我开始思考是否可以通过编写一个全自动化脚本来实现钉钉打卡。经过一段时间的摸索和学习，我终于成功编写出了一个适用于苹果和安卓系统的钉钉打卡脚本。
2024-04-09 15:03
15KB