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FPGA数字万年历（verilog）

本次工程实现了FPGA（EP4CE6）通过LCD显示年、月、日、星期、小时、分钟、秒的功能，并且可以通过按键对显示的数据进行调整，加或减，同时也加入了闹钟和整点报时的功能，根据现实情况，当闹钟和整点的时间发生冲突时，闹钟先亮，我把闹钟的优先级设置为高了，如果达到了闹钟和整点所设置的时间，led灯就会有区分的亮，闹钟前两位led灯亮，整点后两位led灯亮

2023/12/20 17:56:09 8.78MB FPGA

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UE中显示VHDL、Verilog和SystemVerilog的高亮文件

3种最常用的硬件描述语言的高亮文件打包下载。

2023/12/19 20:44:55 6KB verilog vhdl systemverilog fpga

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ad7606_driver.v

由于这几天比较闲，把手里空闲的ad7606ad模块Verilog用FPGA调通了，实现ad76068通道同步采集，并16bit行输出，代码简单，亲测可行，只是结果未转化，需要自己转化。

2023/12/19 12:51:45 11KB fpga

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Verilog的DS18b20代码

Verilog的DS18b20代码，时钟50MHz；

2023/12/16 18:55:34 78KB verilog FPGA DS18B20

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BP_net_work_verilog.txt

最近有网友问我要这个伸进网络verilog实现的源码，我也不知道怎么在文章后面附，所以就传在这里了哈。
源码在这了，只有算法部分，输入值根据自己需要调整哈。

2023/12/16 5:09:20 84KB verilog 神经网络

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FPGAverilog例程+详细的注释

这个分数有点高了，不过资源绝对让你满意，是我自己买了开发板后送的实验例程，都是verilog，有些是基础实验例程，还有的是电设的一些赛题，很实用。

2023/12/16 4:35:51 18.25MB FPGA verilog例程

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verilog_AD9945_TCD1209

AD9945和TCD1209的verilog代码，实测可以使用。
两者都是自己在实验室验证过得

2023/12/16 0:01:25 196KB AD9945、

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基于FPGA的恒虚警算法的实现，Verilog代码

基于FPGA的恒虚警算法的实现，Verilog代码，采用Modelsim仿真

2023/12/15 15:24:57 24.86MB FPGA CFAR Verilog

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verilog写的数字频率计，97年电赛题目

用altera的CYClone系列的fpga，verilog写的代码，可以分离出LCD显示字符和变量（频率值）的程序，用的是AD9226,12位AD，可以精确测量，经调试可测频率高达100MHZ，误差小于0.01.

2023/12/15 10:02:33 662KB 已经过调试

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AES加密模块verilog代码

模块采用verilog硬件描述语言编写，可以用于基于IEEE802.15.4协议的Zigbee技术，加密时采用128bit。

2023/12/15 7:11:41 21KB Zigbee 802.15.4 AES Verilog

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钉钉无人值守自动打卡脚本永不迟到的神器安卓和苹果教程 New!

在日常工作中，钉钉打卡成了我生活中不可或缺的一部分。然而，有时候这个看似简单的任务却给我带来了不少烦恼。每天早晚，我总是得牢记打开钉钉应用，点击"工作台"，再找到"考勤打卡"进行签到。有时候因为工作忙碌，会忘记打卡，导致考勤异常，影响当月的工作评价。而且，由于我使用的是苹果手机，有时候系统更新后，钉钉的某些功能会出现异常，使得打卡变得更加麻烦。另外，我的家人使用的是安卓手机，他们也经常抱怨钉钉打卡的繁琐。尤其是对于那些不太熟悉手机操作的长辈来说，每次打卡都是一次挑战。他们总是担心自己会操作失误，导致打卡失败。为了解决这些烦恼，我开始思考是否可以通过编写一个全自动化脚本来实现钉钉打卡。经过一段时间的摸索和学习，我终于成功编写出了一个适用于苹果和安卓系统的钉钉打卡脚本。

2024-04-09 15:03 15KB 钉钉 钉钉打卡

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