ISE工程。
实现卫星信号产生所需的CA码,有modelsim仿真
2025/5/29 17:50:41 247KB CA VERILO ISE
1
计算机组成原理实验作业,利用modelsim实现CPU流水线工作流程的模拟工作,能够支持加载指令、分支指令、跳转指令的冒险处理,希望给初学者带来一定的帮助。
2025/5/27 4:11:14 18.2MB Verilog Modelsim 流水线 MIPS指令集
1
(超级高清版)经典Verilog示例(100多个经典代码案例).pdf
2025/5/19 22:20:08 152KB verilog 经典代码
1
/**************************************************************************************************///功能简介:使用Verilog编写的一个脉冲信号延时模块,延时时长可设定(小于输入脉冲周期),可精确到一个时钟周期//代码有详细注解,设计项目验证可用,原项目是对一个周期为2ms,高电平脉宽为5us的脉冲信号延时100us输出/**************************************************************************************************/
2025/5/8 12:18:23 1KB 脉冲信号延时 Verilog
1
基于FPGA的verilog实现的AMI码的编解码
2025/5/8 7:20:49 523KB AMI
1
伪随机序列的产生c语言和verilog实现,原理和特性里面都有所介绍,可以直接方便的参考,代码本人撰写完成;
没任何问题!
2025/5/5 7:30:51 818KB 伪随机序列 m序列 verilog
1
verilog语法学习
2025/5/4 9:21:14 4KB verilog
1
利用verilog语言开发OFDM程序,在Xilinx公司的ISE软件环境下调试通过。
2025/4/27 7:36:47 3.61MB verilo FPGA OFDM 无线通信
1
FFT算法在FPGA上的verilog实现详解ImplementationofFastFourierTransform(FFT)onFPGAusingVerilogHDL
2025/4/24 13:08:57 727KB FFT verilog
1
共 867 条记录 首页 上一页 下一页 尾页
在日常工作中,钉钉打卡成了我生活中不可或缺的一部分。然而,有时候这个看似简单的任务却给我带来了不少烦恼。 每天早晚,我总是得牢记打开钉钉应用,点击"工作台",再找到"考勤打卡"进行签到。有时候因为工作忙碌,会忘记打卡,导致考勤异常,影响当月的工作评价。而且,由于我使用的是苹果手机,有时候系统更新后,钉钉的某些功能会出现异常,使得打卡变得更加麻烦。 另外,我的家人使用的是安卓手机,他们也经常抱怨钉钉打卡的繁琐。尤其是对于那些不太熟悉手机操作的长辈来说,每次打卡都是一次挑战。他们总是担心自己会操作失误,导致打卡失败。 为了解决这些烦恼,我开始思考是否可以通过编写一个全自动化脚本来实现钉钉打卡。经过一段时间的摸索和学习,我终于成功编写出了一个适用于苹果和安卓系统的钉钉打卡脚本。
2024-04-09 15:03 15KB 钉钉 钉钉打卡