是一本入书籍,很详细的介绍了整个开发过程,利用FPGA开发板和niosII软核处理器进行系统设计,详细介绍了几个verilog开发实例,并给出了完整的代码,有利于学习。
2025/7/17 15:45:33 103.19MB sopc开发实例
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Verilog语言,Basys3平台,vivado编译,多功能电子钟。
2025/7/14 9:24:47 9KB Verilog basys 电子钟 vivado
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设计PCM30基群帧同步电路电路功能说明:1.输入码流DATA,速率为2.04Mb/S;
每帧256bit,其中前8bit为帧同步码;
偶数帧的帧同步码为10011011,奇数帧的帧同步码为110XXXXX(X为任意值)。
2.系统初始状态为失步态,失步信号FLOSS输出低电平,电路在输入码流里逐比特搜寻同步码,当搜寻到第一个偶帧同步码后,电路转为逐帧搜寻,当连续三帧均正确地搜寻到同步码后,系统状态转为同步态,失步信号输出高电平;
否则电路重新进入逐比特搜寻状态。
3.系统处于同步态后,当连续四帧检出的同步码均错误,则系统转为失步态
2025/7/12 16:14:35 1KB Verilog PCM30
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国外经典的FPGA资料。
里面很全的PDF文件和代码。
费了老大劲找到的。
2025/7/12 13:39:13 16.41MB FPGA Verilog Examples 经典的FPGA资料
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verilog数字电路课程设计--洗衣机洗涤:正转,反转定时脱水
2025/7/6 22:08:09 1.82MB verilo 数字电路 课程设计 洗衣机
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该代码实用Verilog实现UART功能,为Xilinx公司的设计实例。
2025/6/30 4:07:18 10KB Uart FPGA Verilog
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讲述了SPI总线原理,提供主从设备Verilog源码及仿真波形,对初学者有帮助
2025/6/29 18:27:48 145KB SPI FPGA Verilog
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用Verilog写的等效采样程序,对需要写等效采样的朋友很有帮助,更好的理解等效采样技术
2025/6/28 22:13:30 2.34MB 用Verilog写的等效采样程序
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8051的verilog实现适用于各种工作需要的啊
2025/6/28 12:14:38 222KB 8051 verilog
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计算脉冲(先低后高在低)的时间长度,本例中的时钟上50M!
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在日常工作中,钉钉打卡成了我生活中不可或缺的一部分。然而,有时候这个看似简单的任务却给我带来了不少烦恼。 每天早晚,我总是得牢记打开钉钉应用,点击"工作台",再找到"考勤打卡"进行签到。有时候因为工作忙碌,会忘记打卡,导致考勤异常,影响当月的工作评价。而且,由于我使用的是苹果手机,有时候系统更新后,钉钉的某些功能会出现异常,使得打卡变得更加麻烦。 另外,我的家人使用的是安卓手机,他们也经常抱怨钉钉打卡的繁琐。尤其是对于那些不太熟悉手机操作的长辈来说,每次打卡都是一次挑战。他们总是担心自己会操作失误,导致打卡失败。 为了解决这些烦恼,我开始思考是否可以通过编写一个全自动化脚本来实现钉钉打卡。经过一段时间的摸索和学习,我终于成功编写出了一个适用于苹果和安卓系统的钉钉打卡脚本。
2024-04-09 15:03 15KB 钉钉 钉钉打卡