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二级分类:
北航计算机组成Project5
北航计算机组成课Project5资源。
包含:全套流水线cpu源代码,数据通路设计和暂停转发分析excel表,和覆盖所有冲突情况的Mips汇编强测代码。
2023/9/17 12:34:26
636KB
北航计组
Project5
流水线CPU
暂停转发
1
verilog流水线多周期CPU设计
里面有多周期和流水线CPU的VERILOG代码实现,适合学习计算机原理课程设计
2023/8/18 9:14:36
203KB
CPU设计
1
计算机组成实验Project5流水线CPU源代码
通过强测和P5课上测试,支持addu,subu,ori,beq,lw,sw,lui,j,jal,jr,nop指令;
支持转发和暂停处理冲突机制;
仅可用于参考,不要将其直接上传,否则被查重后果自负。
2023/6/13 16:51:29
17KB
Verilog
CPU
流水线
北航
1
MIPS五级流水线CPU(verilog实现)
盘算机组成原理课程试验:一个MIPS五级流水线CPU内含部份源代码以及试验文档,verilog实现,开拓平台为ISE
2023/4/17 22:28:38
369KB
CPU
VERILOG
PIPE
LINING
1
verilog流水线CPU
五级流水CPU,除了最基本的条件、非条件转移指令,算术、逻辑运算指令和访存指令等,还实现了弹压栈指令、子程序调用和前往指令、除法指令和三角函数指令。
代码风格可能不太好,仅供大家参考。
2019/11/19 18:17:46
563KB
CPU
流水线
verilog
1
XilinxSpartan上实现31条MIPS指令流水线CPU
XilinxSpartan-3E上实现31条MIPS指令流水线CPU代码用VerilogHDL编写,含UCF文件和原理阐明图,如有错误请联系邮箱zjuwh@sina.cn指正,谢谢。
2021/3/21 3:43:11
139KB
流水线CPU
1
XilinxSpartan上实现31条MIPS指令流水线CPU
XilinxSpartan-3E上实现31条MIPS指令流水线CPU代码用VerilogHDL编写,含UCF文件和原理阐明图,如有错误请联系邮箱zjuwh@sina.cn指正,谢谢。
2020/11/6 18:08:43
139KB
流水线CPU
1
Verilog言语编写的流水线CPU
组成原理实验课的内容用Verilog言语写的流水线CPU,五级流水
2017/5/7 17:01:51
4.33MB
Verilog
流水线CPU
1
组原课设5段流水线CPU
华科组原课设,在logisim平台实现单周期CPU,5段流水线,理想流水线,插气泡和数据重定向处理各种冲突,包含老师给的各种测试案例和运行结果,以及各种毛病处理。
包括任务书和mips指令集
2021/6/19 16:39:44
1.22MB
logisim
单周期CPU
1
verilog编写的流水线cpu
本科组成原理实验课程作业verilog编写的可执行22条指令的流水线CPU,不触及缓存。
2021/3/27 2:33:05
12.05MB
Verilog
流水线
cpu
1
共 24 条记录
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钉钉无人值守自动打卡脚本 永不迟到的神器 安卓和苹果教程
New!
在日常工作中,钉钉打卡成了我生活中不可或缺的一部分。然而,有时候这个看似简单的任务却给我带来了不少烦恼。 每天早晚,我总是得牢记打开钉钉应用,点击"工作台",再找到"考勤打卡"进行签到。有时候因为工作忙碌,会忘记打卡,导致考勤异常,影响当月的工作评价。而且,由于我使用的是苹果手机,有时候系统更新后,钉钉的某些功能会出现异常,使得打卡变得更加麻烦。 另外,我的家人使用的是安卓手机,他们也经常抱怨钉钉打卡的繁琐。尤其是对于那些不太熟悉手机操作的长辈来说,每次打卡都是一次挑战。他们总是担心自己会操作失误,导致打卡失败。 为了解决这些烦恼,我开始思考是否可以通过编写一个全自动化脚本来实现钉钉打卡。经过一段时间的摸索和学习,我终于成功编写出了一个适用于苹果和安卓系统的钉钉打卡脚本。
2024-04-09 15:03
15KB
钉钉
钉钉打卡
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