通过强测和P5课上测试，支持addu,subu,ori,beq,lw,sw,lui,j,jal,jr,nop指令；
支持转发和暂停处理冲突机制；
仅可用于参考，不要将其直接上传，否则被查重后果自负。
支持转发和暂停处理冲突机制；
仅可用于参考，不要将其直接上传，否则被查重后果自负。
2023/6/13 16:51:29
17KB
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盘算机组成原理课程试验：一个MIPS五级流水线CPU内含部份源代码以及试验文档，verilog实现，开拓平台为ISE
2023/4/17 22:28:38
369KB
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五级流水CPU，除了最基本的条件、非条件转移指令，算术、逻辑运算指令和访存指令等，还实现了弹压栈指令、子程序调用和前往指令、除法指令和三角函数指令。
代码风格可能不太好，仅供大家参考。
代码风格可能不太好，仅供大家参考。
2019/11/19 18:17:46
563KB
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XilinxSpartan-3E上实现31条MIPS指令流水线CPU代码用VerilogHDL编写，含UCF文件和原理阐明图，如有错误请联系邮箱zjuwh@sina.cn指正，谢谢。
2021/3/21 3:43:11
139KB
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XilinxSpartan-3E上实现31条MIPS指令流水线CPU代码用VerilogHDL编写，含UCF文件和原理阐明图，如有错误请联系邮箱zjuwh@sina.cn指正，谢谢。
2020/11/6 18:08:43
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华科组原课设，在logisim平台实现单周期CPU，5段流水线，理想流水线，插气泡和数据重定向处理各种冲突，包含老师给的各种测试案例和运行结果，以及各种毛病处理。
包括任务书和mips指令集
包括任务书和mips指令集
2021/6/19 16:39:44
1.22MB
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其中包含1.利用logisim实现斐波那契数列、Moore及Mealy型有限形态机等题目的电路，及利用logisim实现单周期CPU。
2.利用verilog实现单周期及多周期流水线CPU。
3.利用Mars编写汇编，包括哈密顿回路、循环递归等题目代码
2.利用verilog实现单周期及多周期流水线CPU。
3.利用Mars编写汇编，包括哈密顿回路、循环递归等题目代码
2022/10/4 10:00:08
10.17MB
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本课程设计的总体目标是利用FPGA以及相关外围器件，设计五段流水CPU，要求所设计的流水CPU系统能支持自动和单步运行方式，能正确地执行存放在主存中的程序的功能，对次要的数据流和控制流通过LED、数码管等适时的进行显示，方便监控和调试。
尽可能利用EDA软件或仿真软件对模型机系统中各部件进行仿真分析和功能验证。
尽可能利用EDA软件或仿真软件对模型机系统中各部件进行仿真分析和功能验证。
2017/4/27 9:27:36
92.97MB
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在日常工作中，钉钉打卡成了我生活中不可或缺的一部分。然而，有时候这个看似简单的任务却给我带来了不少烦恼。
每天早晚，我总是得牢记打开钉钉应用，点击"工作台"，再找到"考勤打卡"进行签到。有时候因为工作忙碌，会忘记打卡，导致考勤异常，影响当月的工作评价。而且，由于我使用的是苹果手机，有时候系统更新后，钉钉的某些功能会出现异常，使得打卡变得更加麻烦。
另外，我的家人使用的是安卓手机，他们也经常抱怨钉钉打卡的繁琐。尤其是对于那些不太熟悉手机操作的长辈来说，每次打卡都是一次挑战。他们总是担心自己会操作失误，导致打卡失败。
为了解决这些烦恼，我开始思考是否可以通过编写一个全自动化脚本来实现钉钉打卡。经过一段时间的摸索和学习，我终于成功编写出了一个适用于苹果和安卓系统的钉钉打卡脚本。
2024-04-09 15:03
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