EDA课程方案报告,彩灯抑制器,大学eda本领方案,波及到verilog语言
2023/5/1 2:55:27 196KB eda 课程设计 彩灯
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使用Verilog语言测试AD模块,该法度圭表标准已经由验证,波形经由示波器检测普通。
2023/4/25 7:55:54 1.02MB FPGA Verilog AD TLC549
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这个文件用Verilog语言描摹了jtag的成果
2023/4/24 4:23:34 875KB jtag
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试验内容(ISA2新增3条指令)•用硬件描摹语言(Verilog)方案MIPSCPU,反对于如下指令集•ISA1={ADD/ADDU/SUB/SUBU/SLL/SRL/SRA/SLLV/SRLV/SRAV/AND/OR/XOR/NOR/SLT/SLTU/ADDI/ADDIU/ANDI/ORI/XORI/LUI/SLTI/SLTIU/LB/LBU/LH/LHU/LW/SB/SH/SW/BEQ/BNE/BGEZ/BGTZ/BLEZ/BLTZ/J/JAL/JR/JALR}42条•ISA2={add,sub,addu,subu,addi,ori,lui,and,andi,or,nor,slt,sltu,sll,srl,sllv,srlv,lw,sw,beq,bne,j,jal,jr}24条•用仿真软件Modelsim对于有数据冒险以及抑制冒险的汇编法度圭表标准举行仿文件搜罗源代码以及试验报告。
2023/4/22 6:04:57 269KB 单周期CPU MIPS Verilog 42条指令
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这是一个极其残缺的qpsk调制解挪用fpga实现的工程,在工程中已经能够普通使用,使用Verilog语言,文件中还搜罗了种种滤波器的系数文件,另有matlab仿真文件,全部工程搜罗从串并变更,相位映射,到成型滤波,中通滤波,cic滤波,调制,再到解调过成的下变频,匹配滤波,载波提取,位按时,判决,全部残缺的进程,
2023/4/18 0:01:47 13.23MB QPSK
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本资源中的串口收发协议带奇偶校验,能够实现纵情字符串的收发成果,相对于可用,开拓货物是ISE14.7,用Verilog语言实现。



2023/4/15 2:21:19 1.08MB FPGA Verilog 串口 奇偶校验
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外面有阵列乘法器的代码及实现波形,verilog语言
2023/4/13 0:01:58 125KB 阵列乘法器
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数字信号VLSI方案verilog语言64点快捷傅里叶(FFT)变更
2023/3/24 6:34:52 1.19MB FFT
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本书从用户的角度全面阐述了VerilogHDL语言的重要细节和基本设计方法,并详细引见了Verilog2001版的主要改进部分。
本书重点关注如何应用Verilog语言进行数字电路和系统的设计和验证,而不仅仅讲解语法。
全书从基本概念讲起,并逐渐过渡到编程语言接口以及逻辑综合等高级主题。
书中的内容全部符合VerilogHDLIEEE1364-2001标准。
2023/3/19 0:53:08 13.46MB FPGA Verilog
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Verilog语言实现32位的流水线微处理器的设计,内有正文以便读者参考。
2023/3/11 9:07:39 1.48MB pipeline_cpu
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在日常工作中,钉钉打卡成了我生活中不可或缺的一部分。然而,有时候这个看似简单的任务却给我带来了不少烦恼。 每天早晚,我总是得牢记打开钉钉应用,点击"工作台",再找到"考勤打卡"进行签到。有时候因为工作忙碌,会忘记打卡,导致考勤异常,影响当月的工作评价。而且,由于我使用的是苹果手机,有时候系统更新后,钉钉的某些功能会出现异常,使得打卡变得更加麻烦。 另外,我的家人使用的是安卓手机,他们也经常抱怨钉钉打卡的繁琐。尤其是对于那些不太熟悉手机操作的长辈来说,每次打卡都是一次挑战。他们总是担心自己会操作失误,导致打卡失败。 为了解决这些烦恼,我开始思考是否可以通过编写一个全自动化脚本来实现钉钉打卡。经过一段时间的摸索和学习,我终于成功编写出了一个适用于苹果和安卓系统的钉钉打卡脚本。
2024-04-09 15:03 15KB 钉钉 钉钉打卡