系统阐述数字系统开发的相关知识,主要内容包括EDA技术、FPGA/CPLD器件、Verilog硬件描述语言等。
全书以QuartusⅡ、SynplifyPro软件为平台,以Verilog—1995和Verilog—2001语言标准为依据,以可综合的设计为重点,通过大量经过验证的数字设计实例,系统阐述数字系统设计的方法与技术,由浅入深地介绍Verilog工程开发的知识与技能
2023/9/3 11:38:39 9.91MB EDA FPGA Verilo
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高通的绝密Verilog编码规范(中文版)verilogcodingstyle.pdf
2023/9/2 6:24:35 331KB verilog
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在FPGA平台上,使用verilog语言编写,在quartusii中编译通过,主要功能是接收串口数据,利用内部的fifo保存数据,然后传输给上位机
2023/9/1 14:30:45 122KB fpga 串口程序
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Verilog编写的UART核,可以实现可定义形式数据的收到,测试工作正常
2023/9/1 14:20:58 6.45MB Verilo UAR RS23
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这是个串口通信的Verilog代码,代码简单明了。
在顶层收到PC一个字节然后再发给PC。
适合初学者使用
2023/8/30 12:57:42 3.99MB 串口 Verilog TestBench
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FPGA等精度测频法ISE下verilog实现
2023/8/30 10:15:09 1.47MB FPGA 等精度测频法
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Verilog语言快速入门教程,入门只需一小时
2023/8/29 11:13:31 600KB verilog fpga
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利用Verilog写的32位的2进制转为8个BCD码输出的程序,采用流水线处理,可以用在高速时钟上,而且所需时钟个数为各个位上的数之和。
2023/8/28 19:15:38 1.42MB 2进制转BCD 32位 verilog Quartus
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测试过的匹配滤波器Verilog代码。
用modelsim仿真
2023/8/21 5:01:44 50KB Verilog
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基于Xilinx的AC701开发板编写的Verilog程序,使用FPGA实现以太网UDP通信,主程序是ac701_ethernet_comm.v,其中的IP核请自行例化。
2023/8/21 2:50:25 40KB FPGA UDP AC701 网络通信
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在日常工作中,钉钉打卡成了我生活中不可或缺的一部分。然而,有时候这个看似简单的任务却给我带来了不少烦恼。 每天早晚,我总是得牢记打开钉钉应用,点击"工作台",再找到"考勤打卡"进行签到。有时候因为工作忙碌,会忘记打卡,导致考勤异常,影响当月的工作评价。而且,由于我使用的是苹果手机,有时候系统更新后,钉钉的某些功能会出现异常,使得打卡变得更加麻烦。 另外,我的家人使用的是安卓手机,他们也经常抱怨钉钉打卡的繁琐。尤其是对于那些不太熟悉手机操作的长辈来说,每次打卡都是一次挑战。他们总是担心自己会操作失误,导致打卡失败。 为了解决这些烦恼,我开始思考是否可以通过编写一个全自动化脚本来实现钉钉打卡。经过一段时间的摸索和学习,我终于成功编写出了一个适用于苹果和安卓系统的钉钉打卡脚本。
2024-04-09 15:03 15KB 钉钉 钉钉打卡