一、 实验目的与要求：用verilog语言编写出一个除法器的代码，并在modelsim中进行功能仿真，认真的完成实验报告。
二、 实验设备（环境）及要求：在modelsim环境下编写代码与测试程序，并仿真；
在synplifypro下编译，设置硬件并综合。
三、 实验内容及步骤：1、 选择除法器的算法，本实验开始采用的是减法实现除法器的例子（比如十进制中的a/b，可先比较a与b的大小，如果a＞b,则商加1，a＜=a-b,再进行比较大小，直到a＜b,商不变，余数为a）;2、 选择好算法，进行verilog语言编程，再写好testbench并进行编译与功能仿真；
3、 在中进行初步综合；
4、 完成实验报告；
二、 实验设备（环境）及要求：在modelsim环境下编写代码与测试程序，并仿真；
在synplifypro下编译，设置硬件并综合。
三、 实验内容及步骤：1、 选择除法器的算法，本实验开始采用的是减法实现除法器的例子（比如十进制中的a/b，可先比较a与b的大小，如果a＞b,则商加1，a＜=a-b,再进行比较大小，直到a＜b,商不变，余数为a）;2、 选择好算法，进行verilog语言编程，再写好testbench并进行编译与功能仿真；
3、 在中进行初步综合；
4、 完成实验报告；
2023/9/17 9:56:34
290KB
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DSP算法架构及设计，内容为基于systolic的上三角矩阵求逆电路的实现，里面有详尽的MATLAB/SIMULINK仿真模型，及HDL代码和在modelsim中的仿真程序，非常不错的。
2023/9/13 23:54:06
1.32MB
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采用硬件描述语言verilogHDL写timer,采用golden模型（简单的），用modelsim软件仿真，含整个project。
2023/8/26 22:18:49
42KB
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横向LMS算法是实现自适应数字波束形成的基本方法之一。
提出了一种用Matab/Simulink中DSPBuilder模块库设计算法模型，然后应用FPGA设计软件Modelsim、QuartusII分析自适应滤波器时钟速度和消耗逻辑单元数的设计方法。
实验表明：该方法易于实现、简单可靠。
提出了一种用Matab/Simulink中DSPBuilder模块库设计算法模型，然后应用FPGA设计软件Modelsim、QuartusII分析自适应滤波器时钟速度和消耗逻辑单元数的设计方法。
实验表明：该方法易于实现、简单可靠。
2023/8/3 21:21:23
955KB
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Modelsim代码覆盖率功能Codecoverage，能报告出statement（语句）、branch（分支）、condition（条件）、expression（表达）、toggle（信号翻转）、fsm（有限状态机）等多种覆盖率情况。
详细见博客：http://blog.csdn.net/jackinzhou/article/details/7897189
详细见博客：http://blog.csdn.net/jackinzhou/article/details/7897189
2023/7/31 8:46:47
1.84MB
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本文首先利用MATLAB产生两个频率不一样的正弦信号，并将这两个正弦信号相加，得到一个混叠的波形；
然后利用MATLAB设计一个FIR低通滤波器，并由Verilog实现，联合ISE和Modelsim仿真，实现滤除频率较高的信号，并将滤波后的数据送到MATLAB中分析。
绝对原创。
然后利用MATLAB设计一个FIR低通滤波器，并由Verilog实现，联合ISE和Modelsim仿真，实现滤除频率较高的信号，并将滤波后的数据送到MATLAB中分析。
绝对原创。
2023/6/28 18:05:57
1.08MB
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ModelSim-Altera6.1g破解文件及方法我试过可以使用，放到这个上面只是想自己下次找得到
2023/6/14 23:46:03
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在日常工作中，钉钉打卡成了我生活中不可或缺的一部分。然而，有时候这个看似简单的任务却给我带来了不少烦恼。
每天早晚，我总是得牢记打开钉钉应用，点击"工作台"，再找到"考勤打卡"进行签到。有时候因为工作忙碌，会忘记打卡，导致考勤异常，影响当月的工作评价。而且，由于我使用的是苹果手机，有时候系统更新后，钉钉的某些功能会出现异常，使得打卡变得更加麻烦。
另外，我的家人使用的是安卓手机，他们也经常抱怨钉钉打卡的繁琐。尤其是对于那些不太熟悉手机操作的长辈来说，每次打卡都是一次挑战。他们总是担心自己会操作失误，导致打卡失败。
为了解决这些烦恼，我开始思考是否可以通过编写一个全自动化脚本来实现钉钉打卡。经过一段时间的摸索和学习，我终于成功编写出了一个适用于苹果和安卓系统的钉钉打卡脚本。
2024-04-09 15:03
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