使用verilog编写的精确cordic算法。
公用在alterafpga上。
有详细的注释,pdf文档以及testbench。
2017/6/27 11:41:34 875KB altera fpga cordic verilog
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epm24072路三色LED灯板三色瓜代显示cpld逻辑VERILGO源码,器件位ALTERA-CPLDEPM240T100C5,quartusii10.1逻辑源码工程文件。
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本实验为自主选题设计实验,实验选择具有倒计时显示功能的红黄绿三色交通设计,实验中采用verilogHDL作为设计功能描述语言,选用Altera公司的MAXIIEPM240T100C5最为主控芯片,实验报告中简要引见了MAXII系列器件,并给出了设计电路图,详细的引见了交通灯的设计流程,实验报告中还附有实验代码实验结果照片图。
2018/8/5 2:36:38 2.77MB 交通灯 verilog
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用ModelSim完成了Altera乘法器IP核的仿真,有利于初学者学习
2020/9/13 17:12:12 12.15MB Altera 乘法器 IP核 Modelsim
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ModelSim-Altera破解工具,适合所有版本,留意压缩包里的mgls.dll是没有用的,不要覆盖掉你原来的dll文件。
2021/7/19 5:41:54 1.11MB ModelSim Altera 破解
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基于FPGA的应用技术,采用Altera公司DE2-70开发板的CycloneⅡ系列EP2C70作为核心器件,设计了一种基于FPGA的新型可调信号发生器。
通过QuartusⅡ软件及VerilogHDL编程语言设计LPM_ROM模块定制数据ROM,并通过地址指针读取ROM中不同区域的数据,根据读取数据间隔的不同,实现调整频率功能,该系统可产生正弦波、方波、三角波和锯齿波4种波形信号,并使用嵌入式逻辑分析仪对产生的不同波形信号进行实时测试,实验证明,该可调信号发生器系统软件模仿数据和理论定制波形相吻合。
2022/10/11 13:39:49 1.23MB 信号发生器 EP2C70 Verilog
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本章节对Altera®IP内核设计流程作了概述,协助您快速着手AlteraIP内核的设计。
AlteraIPLibrary是Quartus®II安装进程的一部分,您可以从库中选择并参数化任意AlteraIP内核。
Altera提供了一个集成的参数编辑器,用于定制支持各种应用的IP内核。
参数编辑器将指导您设置参数值及选择端口。
下面章节介绍了基本设计流程以及AlteraIP内核的使用。
2018/8/21 1:26:28 1.21MB 存储器 参数化
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altera_ug_fifo.pdfaudio_dac_fifo.rarFIFO中文应用笔记.pdfFIFO基础知识.docFPGASoPC软硬件协同设计纵横谈.pdfFPGA的VGA视频输出工程文件//freedev_vgaFPGA的VGA视频输出工程文件.rarFreeDevFPGA音频开发环境和平台构建.pdfNios系统基础上的UItraDMA数据传输模式.docSD_Card_Audio//Audio_DAC_FIFO_altera的ip核DE2_SD_Card_Audiosd_audio_aic23.rarSOPC中自定义FIFO接口与DMA数据传输.pdf什么是FIFO.doc关于fifo的一些概念其quartusII中IP的使用.doc在NIOS-II系统中AD数据采集接口的设计与实现.doc基于Avalon总线的TFTLCD控制器的设计.doc基于FPGA+PCI的并行计算平台实现.doc基于LPM的高速FIFO的设计.doc基于NiosII的图像采集和显示的实现.doc基于SOPC的扭振信号测量系统实现研究.doc基于嵌入式Linux的TFTLCDIP及驱动的设计.doc异步FIFO的VHDL设计.doc采用FPGA的高速数据采集系统.doc非IP核相关FIFO设计//FIFO技术在SDH数字交叉连接芯片设计中的应用.pdfKPCI-817数据采集卡.pdfPCI-8325光电隔离型模入接口卡技术说明书.docUSB7325高速光电隔离型模入数据采集模块技术说明书.doc一款低功耗异步FIFO的设计与实现.pdf一种异步FIFO的设计方法.pdf关于异步FIFO设计的探讨.pdf利用FPGA实现异步FIFO设计.doc基于DSP的高速数据采集与处理系统.pdf基于FPGA异步FIFO的研究与实现.pdf基于FPGA的异步FIFO硬件实现.pdf基于FPGA的异步FIFO设计.pdf基于FPGA的高速异步FIFO存储器设计.pdf基于VerilogHDL的异步FIFO设计与实现.pdf异步FIFO亚稳态问题.doc异步FIFO结构.pdf异步FIFO结构及FPGA设计.pdf怎样对FIFO、RAM读写.doc读写数据宽度不同的异步FIFO设计.PDF高速异步FIFO的实现.pdf
2021/2/7 8:09:37 12.71MB Altera FIFO SOPC IP
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Altera的cyclongIV芯片EP4CE6开发板完整原理图,本人画板子可以参考参考,
2017/8/3 20:02:28 1.87MB EP4CE6 开发板 原理图
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本书着眼于实践,引见了FPGA设计开发的大量技巧,内容包括Xilinx开发软件ISE的使用技巧、Altera开发软件Quartus的使用技巧、仿真工具ModelSim的使用技巧、综合工具Synplify的使用技巧以及设计数字电路的一般技巧。
而且立足于实际,引见的技巧都是在实际开发中经常使用到的,作者结合多年的工作经验组织编写了这本书书中总结了各种使用技巧并且提供了具体的使用方法和实例。
读者可以参考书中的技巧,通过实际动手操作掌握各个技巧的使用方法,并且在实际开发工作中运用。
本书可以作为高等院校电子工程、通信工程、计算机、自动化等专业的教材,也可以作为电子工程师的参考手册。
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在日常工作中,钉钉打卡成了我生活中不可或缺的一部分。然而,有时候这个看似简单的任务却给我带来了不少烦恼。 每天早晚,我总是得牢记打开钉钉应用,点击"工作台",再找到"考勤打卡"进行签到。有时候因为工作忙碌,会忘记打卡,导致考勤异常,影响当月的工作评价。而且,由于我使用的是苹果手机,有时候系统更新后,钉钉的某些功能会出现异常,使得打卡变得更加麻烦。 另外,我的家人使用的是安卓手机,他们也经常抱怨钉钉打卡的繁琐。尤其是对于那些不太熟悉手机操作的长辈来说,每次打卡都是一次挑战。他们总是担心自己会操作失误,导致打卡失败。 为了解决这些烦恼,我开始思考是否可以通过编写一个全自动化脚本来实现钉钉打卡。经过一段时间的摸索和学习,我终于成功编写出了一个适用于苹果和安卓系统的钉钉打卡脚本。
2024-04-09 15:03 15KB 钉钉 钉钉打卡