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经典数电书籍Verilog教程夏宇闻第三部分练习题答案，很值得揣摩一下

2023/2/4 2:23:55 354KB Verilog

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数字电子钟verilog课程设计

（1）设计一个能自动计时的电子钟，利用数码管分别显示当前的小时，分钟，秒。
（2）可以通过按键对当前小时、分钟进行调整设置。
（3）在调节当前时间的模式下，短按可实现加法，当长按调节分钟的按键两秒以上时可实现快速连加（每秒四次加一）。
（4）具备闹钟功能，可通过按键设定闹钟时间，当当前时间到达闹钟设定时间时，LED按照预设花型闪烁，并播放闹铃音乐。
（5）具备整点报时功能，当当前时间为整点时，LED组闪烁，并播放整点报时音乐。
（6）具备秒表功能，启动秒表功能时，通过switch来开始秒表的计时。
（7）具备LCD显示功能，LCD除开启菜单时显示菜单外，不断与数码管显示同步变化，在显示闹钟设置时间、秒表计时等的同时显示当前功能名称。
在显示当前时间时，同步显示当前日期。
（8）具有日期设置功能，在LCD上显示当前时间时，同步显示日期。
日期可通过按键调节，有增加和减少两种调节方式，且对闰年的二月有特殊处理。

2023/2/1 22:37:29 15KB verilog 数电课程设计 多功能数字钟

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Verilog_HDL综合设计实例(自动乐曲演奏)

用Verilog演奏梁祝，里面有相关代码及原理引见

2023/1/31 16:39:32 3.68MB Verilog 乐曲演奏

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Round-RobinRR调度verilog代码

2/4/8输出RR调度verilog代码，

2023/1/30 20:21:54 2KB verilog 调度

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AX7103（黑金）Verilog教程

AX7103（黑金）Verilog教程，详细的各个例程阐明，包括PCIE接口技术等，可以用来学习Vivado和Verilog，作为基础文档，非常有用。

2023/1/27 12:02:12 10.54MB Vivado FPGA Verilog 例程

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i2cmaster的verilog源码---第二版，控制核心I2C器件

控制核心I2C器件的主控verilog源码，本人写的第二版代码，实际验证与仿真测试通过。
网上很多的源码，本人觉得十分繁琐，固编写此源码

2023/1/19 6:05:26 2KB i2c verilog

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UARTIP核(verilog代码及说明文档)

使用verilogHDL语言编写的串口IP核，其中的全部代码，经过波形仿真验证，内附说明文档，已经过仿真，可完满运行。

2023/1/18 15:30:06 1.75MB verilog uart ip核

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FPGA实现LVDS信号输出LCD控制器verilog

FPGA实现LVDS信号输出，可输出所需求的RGB等画面，LVDS是单通道输出verilog控制24寸TFT

2023/1/17 10:31:15 2.73MB FPGA LVDS LCD verilog

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【FPGA】【Verilog】【AX301】四则小计算器设计

可以完成包括负数的加减乘除运算的计算器。
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2023/1/17 8:20:53 107KB fpga

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VerilogHDL编写的电子钟

简约使用verilog语言编写的数字时钟，并且可以输入预设时间调整，时分秒分三段描述，简约明了

2023/1/15 21:17:48 2KB Verilog FPGA 电子钟 时钟

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钉钉无人值守自动打卡脚本永不迟到的神器安卓和苹果教程 New!

在日常工作中，钉钉打卡成了我生活中不可或缺的一部分。然而，有时候这个看似简单的任务却给我带来了不少烦恼。每天早晚，我总是得牢记打开钉钉应用，点击"工作台"，再找到"考勤打卡"进行签到。有时候因为工作忙碌，会忘记打卡，导致考勤异常，影响当月的工作评价。而且，由于我使用的是苹果手机，有时候系统更新后，钉钉的某些功能会出现异常，使得打卡变得更加麻烦。另外，我的家人使用的是安卓手机，他们也经常抱怨钉钉打卡的繁琐。尤其是对于那些不太熟悉手机操作的长辈来说，每次打卡都是一次挑战。他们总是担心自己会操作失误，导致打卡失败。为了解决这些烦恼，我开始思考是否可以通过编写一个全自动化脚本来实现钉钉打卡。经过一段时间的摸索和学习，我终于成功编写出了一个适用于苹果和安卓系统的钉钉打卡脚本。

2024-04-09 15:03 15KB 钉钉 钉钉打卡

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