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时钟方案Verilog文件

上传者: shendw818 | 上传时间:2023/3/27 0:25:07 | 文件大小:22KB | 文件类型:v
时钟方案Verilog文件
用于实现时钟的Verilog代码,时钟成果熟年月日,平年分辨,大小月分辨,秒表,闹钟以及整点报时。
可直接用于basy3板写板 本软件ID:10456470

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  • qq_38940612:
    有约束文件吗2018-07-05

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