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FPGA方案与案例开拓

FPGA方案本领与案例开拓详解第二版，内容饱满详尽.以硬件描摹语言（Verilog或者VHDL）所实现的电路方案，能够经由约莫的综合与方案，快捷的烧录至FPGA上举行测试，是现代IC方案验证的本领主流。
这些可编纂元件能够被用来实现一些底子的逻辑门电路（譬如AND、OR、XOR、NOT）大概更繁杂一些的组剖析果譬如解码器或者数学方程式。
在大大都的FPGA外面，这些可编纂的元件里也搜罗影像元件譬如触发器（Flip－flop）大概其余愈加残缺的影像块。

2023/4/7 6:46:44 142.61MB FPGA

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基于Verilog的蜂鸣器播放《纸短情长》音乐

基于EP4CE6F17C8芯片，ROM中加载了《纸短情长》的部份音乐

2023/4/7 5:18:53 4.42MB Verilog

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总线轮询仲裁器Verilog实现

总线轮询仲裁器Verilog实现，提供了一个底子的轮询方式总线仲裁器，值患上参考

2023/4/6 21:01:19 10KB 总线 Verilog

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机组大作业：基于RISC-V架构的45条指令单周期CPU方案

内含CPU齐全Verilog源码、论文详尽剖析，作业下场为优异齐全代码以及论文皆为原创，严禁二次转载！

2023/4/5 20:49:15 5.04MB 计算机组成原理 RISC-V 计算机组成原理大作业 单周期CPU设计

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ECC的verilog代码

ECC的verilog代码，有TESTBENCH文件。

2023/4/3 10:46:01 154KB ECC VERILOG

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ecc16bit的编码和译码的verilog代码，可用于asic仿真和综合

2023/4/3 10:45:01 969B ecc verilog

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FPGA实现DDS正弦波、方波、三角波暴发器Verilog法度圭表标准

2023/4/1 3:07:30 15KB FPGA DDS

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[fpga][ax301][verilog]彩灯展现抑制

"课题是基于FPGA多成果彩灯抑制器的方案，成果是用到三个模块，第一个按键按下时，数码管展现1，彩灯点亮第一种方式，第二个按键按下，数码管展现2，彩灯亮第二种，以此类推起码4种方式的估量"

2023/3/31 14:27:33 11.18MB verilog

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verilog编写的电梯法度圭表标准

verilog编写的电梯法度圭表标准，15层楼的法度圭表标准，3组电梯

2023/3/31 6:09:07 793KB verilog 电梯

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RISC_CPUmodelsim代码

夏宇闻教师的Verilog书，CPU一章的RISC_CPU。
平台：modelsim6.4。
实测可使用，无Error。

2023/3/30 17:27:42 10KB RISC_CPU modelsim

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钉钉无人值守自动打卡脚本永不迟到的神器安卓和苹果教程 New!

在日常工作中，钉钉打卡成了我生活中不可或缺的一部分。然而，有时候这个看似简单的任务却给我带来了不少烦恼。每天早晚，我总是得牢记打开钉钉应用，点击"工作台"，再找到"考勤打卡"进行签到。有时候因为工作忙碌，会忘记打卡，导致考勤异常，影响当月的工作评价。而且，由于我使用的是苹果手机，有时候系统更新后，钉钉的某些功能会出现异常，使得打卡变得更加麻烦。另外，我的家人使用的是安卓手机，他们也经常抱怨钉钉打卡的繁琐。尤其是对于那些不太熟悉手机操作的长辈来说，每次打卡都是一次挑战。他们总是担心自己会操作失误，导致打卡失败。为了解决这些烦恼，我开始思考是否可以通过编写一个全自动化脚本来实现钉钉打卡。经过一段时间的摸索和学习，我终于成功编写出了一个适用于苹果和安卓系统的钉钉打卡脚本。

2024-04-09 15:03 15KB 钉钉 钉钉打卡

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