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计算结构CPU设计verilog
自己写的代码,通过验收和后期的考试;
注释清楚,可扩展性强,方便的添加指令;
cpu架构绝对一级棒。
2023/11/30 16:46:57
369KB
cpu
verilog
quartus
东南大学
1
HDB3解码Verilog程序源码,hdb3_decode.v
HDB3解码Verilog程序源码,hdb3_decode.v,modulehdb3_decode(rst_n,clk,hdb3_in,hdb3_dec,fifo_dec);inputrst_n,clk;input[1:0]hdb3_in;outputhdb3_dec;output[9:0]fifo_dec;
2023/11/30 11:51:26
425KB
HDB3解码
1
基于verilog的摄像头设计
利用FPGA驱动ov7670,将采集到的视频流存放到SDRAM中,通过VGA进行读取显示,显示分辨率640*480(60hz),经过下板验证,采集图像清晰流畅,达到了基本要求。
该工程所有代码全部独立完成。
此设计是基于EP4C10F17C8开发板,可直接下板使用。
其他开发板只需略做修改就可使用。
2023/11/30 4:51:29
54.33MB
FPG
摄像
1
基于FPGA的DS18B20测温代码
采用verilog编写的DS18B20测温程序,包含数码管显示模块
2023/11/28 12:45:50
3.73MB
FPGA
DS18B20
1
占空比测量VerilogHDL
[免费免费]Verilog代码占空比测量,实时读取数据,实时变化
2023/11/27 18:21:39
946B
Verilog计算占空比
1
用verilog编写的sigma-deltaadc例子
用verilog编写的sigma-deltaadc例子应用在计量类adc产品
2023/11/25 23:38:32
4KB
verilog
sigma-delta
adc
1
千兆UDP的Verilog实现源码
该源码包含详细注释,并附上全部设计测试记录,在本人的博文中也有介绍,欢迎需要的朋友下载,并希望能多多交流,分享,一起学习、探讨!
2023/11/21 3:21:45
8.54MB
Verilog
HDL
FPGA
UDP/IP
1
基于Verilog的低功耗矩阵键盘扫描设计
基于Verilog的低功耗矩阵键盘扫描设计,电路处于低功耗模式,在检测到有按键按下时,开始正常工作并扫描按键,判断是哪个按键被按下,得出键值后再次进入低功耗模式。
2023/11/21 2:16:30
3KB
fpga
矩阵键盘
低功耗模式
verilog
1
audioresample(音频重采样)
xilinx的音频重采样模块Verilog源码,可以实现任意采样率的转换,供大家学习。
2023/11/19 1:41:43
24KB
asrc
音频重采样
Verilog
1
用Verilog编的时钟分频程序
这是光通信中PPM调制方式中的时钟分频程序,此程序使用Verilog语言编程,并且编译成功,希望对大家有所帮助
2023/11/18 22:16:49
383KB
分频程序
1
共 886 条记录
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钉钉无人值守自动打卡脚本 永不迟到的神器 安卓和苹果教程
New!
在日常工作中,钉钉打卡成了我生活中不可或缺的一部分。然而,有时候这个看似简单的任务却给我带来了不少烦恼。 每天早晚,我总是得牢记打开钉钉应用,点击"工作台",再找到"考勤打卡"进行签到。有时候因为工作忙碌,会忘记打卡,导致考勤异常,影响当月的工作评价。而且,由于我使用的是苹果手机,有时候系统更新后,钉钉的某些功能会出现异常,使得打卡变得更加麻烦。 另外,我的家人使用的是安卓手机,他们也经常抱怨钉钉打卡的繁琐。尤其是对于那些不太熟悉手机操作的长辈来说,每次打卡都是一次挑战。他们总是担心自己会操作失误,导致打卡失败。 为了解决这些烦恼,我开始思考是否可以通过编写一个全自动化脚本来实现钉钉打卡。经过一段时间的摸索和学习,我终于成功编写出了一个适用于苹果和安卓系统的钉钉打卡脚本。
2024-04-09 15:03
15KB
钉钉
钉钉打卡
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