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USB通信使用CY7C68013slavefifo模式的通信官方源代码,verilog

上传者: olixiango | 上传时间:2024/1/4 19:54:33 | 文件大小:3.5MB | 文件类型:zip
USB通信使用CY7C68013slavefifo模式的通信官方源代码,verilog
USB通信使用CY7C68013slavefifo模式的通信官方源代码,针对fpga的verilog语言,很权威的一个文件 本软件ID:8489581

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(609个子文件3.5MB)USB通信使用CY7C68013slavefifo模式的通信官方源代码,verilog
work.vdbl 19.53KB
work.vdbx 118B
fx2lp_slaveFIFO2b_streamOUT_fpga_top_map.ngm 32.13KB
fx2lp_slaveFIFO2b_streamOUT_fpga_top.xpi 46B
fx2lp_slaveFIFO2b_streamOUT_fpga_top.ngd 16.22KB
......
文件过多,未全部展示
[{"title":"(609个子文件3.5MB)USB通信使用CY7C68013slavefifo模式的通信官方源代码,verilog","children":[{"title":"work.vdbl <span style='color:#111;'>19.53KB</span>","children":null,"spread":false},{"title":"work.vdbx <span style='color:#111;'>118B</span>","children":null,"spread":false},{"title":"fx2lp_slaveFIFO2b_streamOUT_fpga_top_map.ngm <span style='color:#111;'>32.13KB</span>","children":null,"spread":false},{"title":"fx2lp_slaveFIFO2b_streamOUT_fpga_top.xpi <span style='color:#111;'>46B</span>","children":null,"spread":false},{"title":"fx2lp_slaveFIFO2b_streamOUT_fpga_top.ngd <span style='color:#111;'>16.22KB</span>","children":null,"spread":false},{"title":"......","children":null,"spread":false},{"title":" <span style='color:steelblue;'>文件过多,未全部展示</span>","children":null,"spread":false}],"spread":true}]

评论信息

  • feiniao777:
    没用,资料功能太简单。2016-10-25
  • feiniao777:
    没用,资料功能太简单。2016-10-25
  • fyduan:
    没有使用,资料不怎么好用2016-07-19
  • fyduan:
    没有使用,资料不怎么好用2016-07-19
  • zhouxiaoxiaodou:
    没有搞明白里面的data_In和data_out为什么要分开写??2016-03-15
  • zhouxiaoxiaodou:
    没有搞明白里面的data_In和data_out为什么要分开写??2016-03-15

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