2001年全国电子设计大赛波形发生器，可以产生正弦波，矩形波，方波以及三种波形的叠加。
频率可控，步进100HZ。
频率可控，步进100HZ。
2025/11/29 5:48:01
23.82MB
1
按照IEEE754浮点数标准，完整的浮点数加乘除四则运算的程序，每个都是单独的一个文件，注释完整。
编译仿真全通过！
编译仿真全通过！
2025/11/28 3:39:33
2KB
1
这是数字调制解调技术的MATLAB与FPGA实现——AlteraVerilog版书的随书光盘。
里面有FPGA工程和MATLAB.m原文件。
里面有FPGA工程和MATLAB.m原文件。
2025/11/27 6:11:29
115.97MB
1
1.单极性非归零码（NRZ码）2.双极性非归零码（NRZ码）3.单极性归零码（RZ码）4.双极性归零码（RZ码）5.差分码6.交替极性码（AMI码）7.分相码（曼彻斯特码）8.编码信号反转码（CMI码）
2025/11/26 12:23:22
146KB
1
OV7670摄像头模块负责图像的实时釆集工作。
OV7670内部相关寄存器的配置信息被写入到控制模块，在程序运行时通过I²C总线与OV7670的I²C接口进行信息交互，将OV7670初始化为VGA分辨率、输出RGB565格式数据的模式。
釆集到的图像信息经过写FIFO后，在釆用VerilogHDL设计的SDRAM控制器的控制下，被送至SDRAM进行存储。
图像数据经过图像处理模块(Sobel)被发送到VGA控制器，经VGA接口电路，显示在VGA显器上。
OV7670内部相关寄存器的配置信息被写入到控制模块，在程序运行时通过I²C总线与OV7670的I²C接口进行信息交互，将OV7670初始化为VGA分辨率、输出RGB565格式数据的模式。
釆集到的图像信息经过写FIFO后，在釆用VerilogHDL设计的SDRAM控制器的控制下，被送至SDRAM进行存储。
图像数据经过图像处理模块(Sobel)被发送到VGA控制器，经VGA接口电路，显示在VGA显器上。
2025/11/22 19:30:13
8.17MB
1
在数字信号处理领域，小波变换无论在理论研究还是工程应用方面都具有广泛的价值，因此高性能离散小波变换的FPGA实现架构的研究就显得尤为重要。
本文针对db8(Daubechies8)小波设计了一个16阶16位的正、反变换系统，用DE2开发板进行了系统验证，在FPGA的逻辑单元资源消耗12%的情况下，正、反变换的最高时钟频率分别达到了217.72MHz、217.58MHz
本文针对db8(Daubechies8)小波设计了一个16阶16位的正、反变换系统，用DE2开发板进行了系统验证，在FPGA的逻辑单元资源消耗12%的情况下，正、反变换的最高时钟频率分别达到了217.72MHz、217.58MHz
2025/11/16 20:06:37
1.13MB
1
基于V7的FPGA，Micro的DDR3，资料包括用到的ibis模型，Layout文件、原理图文件。
以及详细仿真设置方法，教你一步步学会DDR仿真，学会sigrity的仿真操作。
以及详细仿真设置方法，教你一步步学会DDR仿真，学会sigrity的仿真操作。
2025/11/13 2:09:30
23.9MB
1
在日常工作中，钉钉打卡成了我生活中不可或缺的一部分。然而，有时候这个看似简单的任务却给我带来了不少烦恼。
每天早晚，我总是得牢记打开钉钉应用，点击"工作台"，再找到"考勤打卡"进行签到。有时候因为工作忙碌，会忘记打卡，导致考勤异常，影响当月的工作评价。而且，由于我使用的是苹果手机，有时候系统更新后，钉钉的某些功能会出现异常，使得打卡变得更加麻烦。
另外，我的家人使用的是安卓手机，他们也经常抱怨钉钉打卡的繁琐。尤其是对于那些不太熟悉手机操作的长辈来说，每次打卡都是一次挑战。他们总是担心自己会操作失误，导致打卡失败。
为了解决这些烦恼，我开始思考是否可以通过编写一个全自动化脚本来实现钉钉打卡。经过一段时间的摸索和学习，我终于成功编写出了一个适用于苹果和安卓系统的钉钉打卡脚本。
2024-04-09 15:03
15KB