Writeleveling功能和Fly_by拓扑密不可分。
Fly_by拓扑主要应用于时钟、地址、命令和控制信号，该拓扑可以有效的减少stub的数量和他们的长度，但是却会导致时钟和Strobe信号在每个芯片上的飞行时间偏移,这使得控制器（FPGA或者CPU）很难保持tDQSS、tDSS和tDSH这些参数满足时序规格。
因此writeleveling应运而生，这也是为什么在DDR3里面使用fly_by结构后数据组可以不用和时钟信号去绕等长的原因，数据信号组与组之间也不用去绕等长，而在DDR2里面数据组还是需要和时钟有较宽松的等长要求的。
Fly_by拓扑主要应用于时钟、地址、命令和控制信号，该拓扑可以有效的减少stub的数量和他们的长度，但是却会导致时钟和Strobe信号在每个芯片上的飞行时间偏移,这使得控制器（FPGA或者CPU）很难保持tDQSS、tDSS和tDSH这些参数满足时序规格。
因此writeleveling应运而生，这也是为什么在DDR3里面使用fly_by结构后数据组可以不用和时钟信号去绕等长的原因，数据信号组与组之间也不用去绕等长，而在DDR2里面数据组还是需要和时钟有较宽松的等长要求的。
2023/12/19 7:50:35
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Altera_stratixVGX_5sgxea7kf40_fpga开发板cadenceorcad硬件原理图+PCB文件，CadenceAllegro设计的工程文件，包括完整的原理图和PCB图，可作为你产品设计的参考。
2023/12/17 11:37:54
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在FPGA开发平台上，通过按键控制一个弹球小游戏。
输出VGA显示信号输送到显示器上显示。
输出VGA显示信号输送到显示器上显示。
2023/12/17 5:36:46
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FPGA控制AD9226进行AD采集，最大65M，代码是用verlog写的！本人亲测可用。
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，同时还有仿真！FPGA控制AD9226进行AD采集，最大65M，代码是用verlog写的！本人亲测可用。
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，同时还有仿真！
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，同时还有仿真！FPGA控制AD9226进行AD采集，最大65M，代码是用verlog写的！本人亲测可用。
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，同时还有仿真！
2023/12/15 17:03:27
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用altera的CYClone系列的fpga，verilog写的代码，可以分离出LCD显示字符和变量（频率值）的程序，用的是AD9226,12位AD，可以精确测量，经调试可测频率高达100MHZ，误差小于0.01.
2023/12/15 10:02:33
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Altera的Quartus软件各类IP核的license,适用于FPGA等硬件开发，Quartus16.0亲测可用，已知最全的IP核license。
先看我的博客再决定是否下载，会有惊喜的。
先看我的博客再决定是否下载，会有惊喜的。
2023/12/13 18:32:07
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在日常工作中，钉钉打卡成了我生活中不可或缺的一部分。然而，有时候这个看似简单的任务却给我带来了不少烦恼。
每天早晚，我总是得牢记打开钉钉应用，点击"工作台"，再找到"考勤打卡"进行签到。有时候因为工作忙碌，会忘记打卡，导致考勤异常，影响当月的工作评价。而且，由于我使用的是苹果手机，有时候系统更新后，钉钉的某些功能会出现异常，使得打卡变得更加麻烦。
另外，我的家人使用的是安卓手机，他们也经常抱怨钉钉打卡的繁琐。尤其是对于那些不太熟悉手机操作的长辈来说，每次打卡都是一次挑战。他们总是担心自己会操作失误，导致打卡失败。
为了解决这些烦恼，我开始思考是否可以通过编写一个全自动化脚本来实现钉钉打卡。经过一段时间的摸索和学习，我终于成功编写出了一个适用于苹果和安卓系统的钉钉打卡脚本。
2024-04-09 15:03
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