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鲍利斯塔所著的《电路分析导论》是电路分析的入门教材,主要内容包括:电压与电流、电阻、电容、电感、磁路、变压器、串并联交直流电路的等效化简、复杂交直流电路方程的列写、交直流电路中的网络定理、交直流电路的功率、谐振电路、滤波器与伯德图、RC及RL电路对直源电源的响应、RC电路对周期脉冲电源的响应、多相电路、非正弦周期电流电路,以及系统的端口分析等。
本教材具有理论分析与工程应用相结合的特点,包含众多的工程案例、严格运用计量单位、经常使用元件参数标称值等,处处体现了教材面向工程教育的特色。
由浅入深的引导式叙述、活泼亲和的教材语言、精美形象的插图,会让自学者倍感愉悦。
  本书可作为高等院校电气类、电子信息类、自动化类专业本科生“电路理论”、“电路分析”课程教材或教学参考书,也可供工程技术人员和电路爱好者参考。
2024/8/16 15:46:29 46.02MB 电路 鲍利斯塔
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操作系统综合性实验包含代码源程序实验报告死锁检测资源分配图化简法
2024/5/5 14:02:18 208KB 操作系统 综合性实验 代码 源程序
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数据结构课程设计表达式类型的实现  ⑴以字符序列的形式输入语法正确的前缀表示式并构成表达式E  ⑵用带括号的中缀表达式输出表达式E  ⑶实现对变量x的赋值,变量初始值为0  ⑷对算术表达式求值  ⑸构造新的复合表达式(E1)P(E2)  ⑹对表达式进行化简
2024/4/2 16:12:18 646KB 数据结构 课程设计 表达式实现
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1.实验内容每一个正规集都可以由一个状态数最少的DFA所识别,这个DFA是唯一的(不考虑同构的情况)。
任意给定的一个DFA,根据以下算法设计一个C程序,将该DFA化简为与之等价的最简DFA。
2.实验设计分析2.1实验设计思路根据实验指导书和书本上的相关知识,实现算法。
2.2实验算法(1)构造具有两个组的状态集合的初始划分I:接受状态组F和非接受状态组Non-F。
(2)对I采用下面所述的过程来构造新的划分I-new.ForI中每个组GdoBegin当且仅当对任意输入符号a,状态s和读入a后转换到I的同一组中;
/*最坏情况下,一个状态就可能成为一个组*/用所有新形成的小组集代替I-new中的G;end(3)如果I-new=I,令I-final=I,再执行第(4)步,否则令I=I=new,重复步骤(2)。
(4)在划分I-final的每个状态组中选一个状态作为该组的代表。
这些代表构成了化简后的DFA M'状态。
令s是一个代表状态,而且假设:在DFAM中,输入为a时有从s到t转换。
令t所在组的代表是r,那么在M’中有一个从s到r的转换,标记为a。
令包含s0的状态组的代表是M’的开始状态,并令M’的接受状态是那些属于F的状态所在组的代表。
注意,I-final的每个组或者仅含F中的状态,或者不含F中的状态。
(5)如果M’含有死状态(即一个对所有输入符号都有刀自身的转换的非接受状态d),则从M’中去掉它;
删除从开始状态不可到达的状态;
取消从任何其他状态到死状态的转换。






2024/1/27 6:58:27 1KB DFA化简 C++ 编译原理
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基于VHDL的数字闹钟设计随着EDA技术的发展和应用领域的扩大与深入EDA技术在电子信息、通信、自动控制及计算机应用领域的重要性日益突出。
EDA技术就是以计算机为工具设计者在EDA软件平台上用硬件描述语言HDL完成设计文件然后由计算机自动地完成逻辑编译、化简、分割、综合、优化、布局、布线和仿真直至对于特定目标芯片的适配编译、逻辑映射和编程下载等工作。
本设计介绍了基于VHDL硬件描述语言设计的多功能数字闹钟的思路和技巧并在QuartusII开发环境中编译和仿真所设计的程序并逐一调试验证程序的运行状况。
仿真和验证的结果表明该设计方法切实可行该数字闹钟可以实现调时定时闹钟功能具有一定的实际应用性。
2023/12/24 22:43:21 5.04MB VHDL
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该软件可以快速地化简用大写字母作为逻辑变量的多变量复杂与或非逻辑表达式至最简形式,支持多级括号嵌套。
2023/11/24 5:33:43 1.44MB 逻辑函数 公式化简器 与或非
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Douglas一Peukcer算法是目前公认的线状要素化简经典算法。
C#编写,使用很方便
2023/10/18 17:46:44 5KB C# 道格拉斯 Douglas
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1、问题描述定义一个整数类。
定义一个分数类,由整数类派生。
能对分数进行各种计算和输入/输出。
2、功能要求(1)定义整数类和分数类。
其中,包括构造函数、析构函数、显示函数等。
(2)输入/输出:对流提取和流插入运算符进行重载。
(3)计算功能:可进行分数的加、减、乘和除法运算。
(4)化简功能:将分数化简为最简分数。
(5)异常处理功能:分数中分母不能为零。
(6)菜单功能:每种功能的操作都是在菜单中进行相应选择。
2023/10/2 22:21:23 4KB c++ 分数类 计算器
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BCD转余3码,使用有限状态机的方式实现时,如何得到状态转移图?书中一下子就给出了化简过的状态转移图,令人难以看懂。
本文档一步步进行分析,让你了然于心。
对初学状态机的同学很有帮助。
2023/9/27 12:55:31 520KB Verilog 前端 状态转移图 FSM
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EDA(ElectronicDesignAutomation)电子设计自动化技术作为现代电子技术的核心,它依赖功能强大的计算机,在EDA工具软件平台上,对以硬件描述语言HDL为系统逻辑描述手段完成的设计文件,自动完成逻辑编译,逻辑化简,逻辑分割,逻辑综合,结构综合,以及逻辑优化和仿真测试,直至实现既定的电子线路系统功能。
EDA技术使得设计者的工作仅限于利用软件的方式,即利用既定描述语言和EDA软件来完成对系统硬件功能的实现。
不难理解,EDA技术已不是某一学科的分支,或某种新的技能技术,它应该是一综合性学科,它融合多学科于一体,又渗透于各学科之中,它打破了软件和硬件间的壁垒,使计算机的软件技术与硬件实现、设计效率和产品性能合二为一,它代表了电子设计技术和应用技术的发展方向。
CPLD即复杂可编程逻辑器件,早期CPLD是从GAL的结构扩展而来,但针对GAL的缺点进行了改进,因此可用于各种现实生活中的应用,比如说本次课程设计数字跑表。
2023/8/27 7:16:27 569KB EDA QuartusⅡ CPLD VHDL
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在日常工作中,钉钉打卡成了我生活中不可或缺的一部分。然而,有时候这个看似简单的任务却给我带来了不少烦恼。 每天早晚,我总是得牢记打开钉钉应用,点击"工作台",再找到"考勤打卡"进行签到。有时候因为工作忙碌,会忘记打卡,导致考勤异常,影响当月的工作评价。而且,由于我使用的是苹果手机,有时候系统更新后,钉钉的某些功能会出现异常,使得打卡变得更加麻烦。 另外,我的家人使用的是安卓手机,他们也经常抱怨钉钉打卡的繁琐。尤其是对于那些不太熟悉手机操作的长辈来说,每次打卡都是一次挑战。他们总是担心自己会操作失误,导致打卡失败。 为了解决这些烦恼,我开始思考是否可以通过编写一个全自动化脚本来实现钉钉打卡。经过一段时间的摸索和学习,我终于成功编写出了一个适用于苹果和安卓系统的钉钉打卡脚本。
2024-04-09 15:03 15KB 钉钉 钉钉打卡