《基于XILINXFPGA的OFDM通信系统基带设计》以无线局域网物理层标准IEEE802．11a为实例，研究如何在FPGA上实现一个OFDM通信系统的基带收发机。
《基于XILINXFPGA的OFDM通信系统基带设计》在系统地给出了收发机模块划分的基础上，对每个模块的算法和FPGA实现进行详细探讨，内容涵盖一个完整无线通信系统的绝大部分模块，包括扰码、编码、交织、OFDM调制／解调、帧同步、频偏校正、符号同步、采样时钟同步、信道均衡、viterbi解码等。
《基于XILINXFPGA的OFDM通信系统基带设计》所有模块均在Xilinx公司大学计划Spartan一3EStarterKit开发板上验证通过，随书光盘附所有ISE工程文件和Verilog源码。
,《基于XILINXFPGA的OFDM通信系统基带设计》适用于电子与通信行业的高校学生和公司研究人员，既可以作为高年级本科生和研究生的教学教材，也可以作为通信行业技术人员的参考书和培训教材。
《基于XILINXFPGA的OFDM通信系统基带设计》在系统地给出了收发机模块划分的基础上，对每个模块的算法和FPGA实现进行详细探讨，内容涵盖一个完整无线通信系统的绝大部分模块，包括扰码、编码、交织、OFDM调制／解调、帧同步、频偏校正、符号同步、采样时钟同步、信道均衡、viterbi解码等。
《基于XILINXFPGA的OFDM通信系统基带设计》所有模块均在Xilinx公司大学计划Spartan一3EStarterKit开发板上验证通过，随书光盘附所有ISE工程文件和Verilog源码。
,《基于XILINXFPGA的OFDM通信系统基带设计》适用于电子与通信行业的高校学生和公司研究人员，既可以作为高年级本科生和研究生的教学教材，也可以作为通信行业技术人员的参考书和培训教材。
2023/10/13 14:47:12
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给大家分享一个我写的用FPGA实现的实时连通区识别源代码。
具体介绍请看下文。
源代码附件里有，或者给我发邮件索取此算法的特点是：1）仅用一片低端FPGA即可实现，无需外接任何存储器。
用Xilinx的LX25就能装下，大概只用了十几个块RAM，其余的逻辑也不多。
2）实时性高，延时固定且很小。
由于该方法进行的是并行流水线处理，即对图像扫描一遍就可完成对所有连通区域的识别，因此识别每个连通区域的延时都是固定的，并不会因为图像中连通区域多，延时就增加。
该延时也很小，约扫描十几行图像的时间。
其实该算法用嵌入式cpu或dsp也可以实现，也可以做到消耗内存少，延时小。
3）能同时给出连通区域的各种统计信息。
该方法在识别出连通区域的同时还能给出该连通区域的面积、周长、外切矩形中心点坐标等统计信息。
还可以统计出该连通区内某特定颜色的点有多少个之类的信息。
4）可靠性高。
对一些特殊形状的连通区，例如U型W型等，都能识别并给出正确的统计信息。
具体介绍请看下文。
源代码附件里有，或者给我发邮件索取此算法的特点是：1）仅用一片低端FPGA即可实现，无需外接任何存储器。
用Xilinx的LX25就能装下，大概只用了十几个块RAM，其余的逻辑也不多。
2）实时性高，延时固定且很小。
由于该方法进行的是并行流水线处理，即对图像扫描一遍就可完成对所有连通区域的识别，因此识别每个连通区域的延时都是固定的，并不会因为图像中连通区域多，延时就增加。
该延时也很小，约扫描十几行图像的时间。
其实该算法用嵌入式cpu或dsp也可以实现，也可以做到消耗内存少，延时小。
3）能同时给出连通区域的各种统计信息。
该方法在识别出连通区域的同时还能给出该连通区域的面积、周长、外切矩形中心点坐标等统计信息。
还可以统计出该连通区内某特定颜色的点有多少个之类的信息。
4）可靠性高。
对一些特殊形状的连通区，例如U型W型等，都能识别并给出正确的统计信息。
2023/10/2 11:07:01
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数字调制解调技术，同步技术，滤波技术的MATLAB与FPGA实现的系列书籍ALTERA版本（3本）_杜勇编著
2023/9/18 8:53:28
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FFT算法的一种FPGA实现，OFDM(正交频分复用)是一种多载波数字调制技术,被公认为是一种实现高速双向无线数据通信的良好方法。
在OFDM系统中,各子载波上数据的调制和解调是采用FFT(快速傅里叶变换)算法来实现的。
因此在OFDM系统中,FFT的实现方案是一个关键因素。
其运算精度和速度必须能够达到系统指标。
对于一个有512个子载波,子载波带宽20kHz的OFDM系统中,要求在50Λs内完成
在OFDM系统中,各子载波上数据的调制和解调是采用FFT(快速傅里叶变换)算法来实现的。
因此在OFDM系统中,FFT的实现方案是一个关键因素。
其运算精度和速度必须能够达到系统指标。
对于一个有512个子载波,子载波带宽20kHz的OFDM系统中,要求在50Λs内完成
2023/8/21 4:03:26
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基于Xilinx的AC701开发板编写的Verilog程序，使用FPGA实现以太网UDP通信，主程序是ac701_ethernet_comm.v，其中的IP核请自行例化。
2023/8/21 2:50:25
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在日常工作中，钉钉打卡成了我生活中不可或缺的一部分。然而，有时候这个看似简单的任务却给我带来了不少烦恼。
每天早晚，我总是得牢记打开钉钉应用，点击"工作台"，再找到"考勤打卡"进行签到。有时候因为工作忙碌，会忘记打卡，导致考勤异常，影响当月的工作评价。而且，由于我使用的是苹果手机，有时候系统更新后，钉钉的某些功能会出现异常，使得打卡变得更加麻烦。
另外，我的家人使用的是安卓手机，他们也经常抱怨钉钉打卡的繁琐。尤其是对于那些不太熟悉手机操作的长辈来说，每次打卡都是一次挑战。他们总是担心自己会操作失误，导致打卡失败。
为了解决这些烦恼，我开始思考是否可以通过编写一个全自动化脚本来实现钉钉打卡。经过一段时间的摸索和学习，我终于成功编写出了一个适用于苹果和安卓系统的钉钉打卡脚本。
2024-04-09 15:03
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