思杰7.15最新全套实验手册PoC手册-Lab01虚拟主机基础环境安装1.0PoC手册-Lab02微软基础构架环境安装1.0PoC手册-Lab03XenDesktop基本安装及配置1.0
2023/12/24 15:19:02 101.28MB Citrix 虚拟化实验手 思杰POC手 思杰最新PO
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前言1范围2规范性引用文件3术语和定义4缩略语5文档过程5.1概述5.2源材料准备5.3文档计划5.4文档开发5.5评审5.6与其他公司的文档开发子合同6文档编制要求6.1软件生存周期与各种文档的编制6.2文档编制中的考虑因素7文档编制格式7.1可行性分析(研究)报告(FAR)7.2软件开发计划(SDP)7.3软件测试计划(STP)7.4软件安装计划(SIP)7.5软件移交计划(STrP)7.6运行概念说明(OCD)7.7系统/子系统需求规格说明(SSS)7.8接口需求规格说明(IRS)7.9系统/子系统设计(结构设计)说明(SSDD)7.10接口设计说明(IDD)7.11软件需求规格说明(SRS)7.12数据需求说明(DRD)7.13软件(结构)设计说明(SDD)7.14数据库(顶层)设计说明(DBDD)7.15软件测试说明(STD)7.16软件测试报告(STR)7.17软件配置管理计划(SCMP)7.18软件质量保证计划(SQAP)7.19开发进度月报(DPMR)7.20项目开发总结报告(PDSR)7.21软件产品规格说明(SPS)7.22软件版本说明(SVD)7.23软件用户手册(SUM)7.24计算机操作手册(COM)7.25计算机编程手册(CPM)附录A(规范性附录)面向对象软件的文档编制A.1综述A.2总体说明文档A.3用况图文档A.4类图文档A.5顺序图文档A.6协作图文档A.7状态图文档A.8活动图文档A.9构件图文档A.10部署图文档A.11包图文档参考文献
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python2.7.15版本,下载后直接点击解压,根据系统安装对应版本
2023/8/1 21:46:11 36.57MB python 2.7.15
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MyEtherWallet是麻省理工大学开发开源的钱包程序,支持本地打开index进行生成钱包,离线买卖,接收,发送,智能合约,千余种代币,币种兑换。
2022/12/4 4:34:33 21.13MB MyEtherWallet
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很实用的Verilog实例!目录:王金明:《VerilogHDL程序设计教程》程序例子,带说明。
【例3.1】4位全加器【例3.2】4位计数器【例3.3】4位全加器的仿真程序【例3.4】4位计数器的仿真程序【例3.5】“与-或-非”门电路【例5.1】用case语句描述的4选1数据选择器【例5.2】同步置数、同步清零的计数器【例5.4】用initial过程语句对测试变量A、B、C赋值【例5.5】用begin-end串行块产生信号波形【例5.6】用fork-join并行块产生信号波形【例5.7】持续赋值方式定义的2选1多路选择器【例5.8】阻塞赋值方式定义的2选1多路选择器【例5.9】非阻塞赋值【例5.10】阻塞赋值【例5.11】模为60的BCD码加法计数器【例5.12】BCD码—七段数码管显示译码器【例5.13】用casez描述的数据选择器【例5.15】用for语句描述的七人投票表决器【例5.16】用for语句实现2个8位数相乘【例5.17】用repeat实现8位二进制数的乘法【例5.18】同一循环的不同实现方式【例5.19】使用了`include语句的16位加法器【例5.20】条件编译举例【例6.1】加法计数器中的进程【例6.2】任务举例【例6.3】测试程序【例6.4】函数【例6.5】用函数和case语句描述的编码器(不含优先顺序)【例6.6】阶乘运算函数【例6.7】测试程序【例6.8】顺序执行模块1【例6.9】顺序执行模块2【例6.10】并行执行模块1【例6.11】并行执行模块2【例7.1】调用门元件实现的4选1MUX【例7.2】用case语句描述的4选1MUX【例7.3】行为描述方式实现的4位计数器【例7.4】数据流方式描述的4选1MUX【例7.5】用条件运算符描述的4选1MUX【例7.6】门级结构描述的2选1MUX【例7.7】行为描述的2选1MUX【例7.8】数据流描述的2选1MUX【例7.9】调用门元件实现的1位半加器【例7.10】数据流方式描述的1位半加器【例7.11】采用行为描述的1位半加器【例7.12】采用行为描述的1位半加器【例7.13】调用门元件实现的1位全加器【例7.14】数据流描述的1位全加器【例7.15】1位全加器【例7.16】行为描述的1位全加器【例7.17】混合描述的1位全加器【例7.18】结构描述的4位级连全加器【例7.19】数据流描述的4位全加器【例7.20】行为描述的4位全加器【例8.1】$time与$realtime的区别【例8.2】$random函数的使用【例8.3】1位全加器进位输出UDP元件【例8.4】包含x态输入的1位全加器进位输出UDP元件【例8.5】用简缩符“?”表述的1位全加器进位输出UDP元件【例8.6】3选1多路选择器UDP元件【例8.7】电平敏感的1位数据锁存器UDP元件【例8.8】上升沿触发的D触发器UDP元件【例8.9】带异步置1和异步清零的上升沿触发的D触发器UDP元件【例8.12】延迟定义块举例【例8.13】激励波形的描述【例8.15】用always过程块产生两个时钟信号【例8.17】存储器在仿真程序中的使用【例8.18】8位乘法器的仿真程序【例8.19】8位加法器的仿真程序【例8.20】2选1多路选择器的仿真【例8.21】8位计数器的仿真【例9.1】基本门电路的几种描述方法【例9.2】用bufif1关键字描述的三态门【例9.3】用assign语句描述的三态门【例9.4】三态双向驱动器【例9.5】三态双向驱动器【例9.6】3-8译码器【例9.7】8-3优先编码器【例9.8】用函数定义的8-3优先编码器【例9.9】七段数码管译码器【例9.10】奇偶校验位产生器【例9.11】用if-else语句描述的4选1MUX【例9.12】用case语句描述的4选1MUX【例9.13】用组合电路实现的ROM【例9.14】基本D触发器【例9.15】带异步清0、异步置1的
2020/10/10 20:05:56 127KB Verilog 实例 经典
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在日常工作中,钉钉打卡成了我生活中不可或缺的一部分。然而,有时候这个看似简单的任务却给我带来了不少烦恼。 每天早晚,我总是得牢记打开钉钉应用,点击"工作台",再找到"考勤打卡"进行签到。有时候因为工作忙碌,会忘记打卡,导致考勤异常,影响当月的工作评价。而且,由于我使用的是苹果手机,有时候系统更新后,钉钉的某些功能会出现异常,使得打卡变得更加麻烦。 另外,我的家人使用的是安卓手机,他们也经常抱怨钉钉打卡的繁琐。尤其是对于那些不太熟悉手机操作的长辈来说,每次打卡都是一次挑战。他们总是担心自己会操作失误,导致打卡失败。 为了解决这些烦恼,我开始思考是否可以通过编写一个全自动化脚本来实现钉钉打卡。经过一段时间的摸索和学习,我终于成功编写出了一个适用于苹果和安卓系统的钉钉打卡脚本。
2024-04-09 15:03 15KB 钉钉 钉钉打卡