矽力杰升降压芯片
2024/2/21 21:09:24 1.55MB 芯片
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wangwei修改20180824-0可正常收发数据自己编译测试通过单片机为STM32F407支持LAN8720芯片LWIP网络支持支持多个客户端服务器地址:192.168.1.100服务端口号:8087
2024/2/21 19:28:27 1.76MB LWIP RAW_TCP lwip RAW
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矽力杰升降压芯片
2024/2/20 23:27:58 720KB 芯片
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本文件用于描述USB3125T的使用方法,该芯片为自主研发,具有工作电路简单,传输稳定,无延时,不丢包吧,价格便宜,供货周期短等特点。
USB3125T设备提供USB端口和MIDIUART串行端口之间的桥接。
它是USB-to-MIDI专业芯片,支持一个USB2.0端口,一个MIDI输出端口和一个MIDI输入端口。
该芯片只需简单的外围电路便可以工作。
2024/2/20 20:49:14 1.22MB USB转MIDI MIDI芯片 MIDI转USB USB3215T
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phy_mdio使用systemverilog实现。
通过mdio接口读写以太网phy芯片。
2024/2/20 14:48:13 3KB phy mdio接口 systemverilog
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嵌入式软件编程,AutosarMCAL配置
2024/2/20 9:11:30 56.61MB RH850RM
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1.将要解包的boot.img拷贝过来,执行脚本sourceunpack.sh,解包boot.img;
2.进入到文件夹ramdisk,编辑需要的文件,比如init.rc,init.amlogic.board.rc,替换init,编辑fstab等;
还可以替换内核code,即将out/target/product/xxxx/kernel改名为boot.img-kernel.3.重新打包成新的boot.img,执行脚本sourcepack.sh,即可打包成新的boot-new.img.以上避免重新编译boot.img,可节省时间。
2024/2/20 2:07:01 8.17MB 解包打包
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使用Verilog语言,可以对PHY88E1111芯片通过MDIO口进行寄存器的读写工作,以完成相应的配置。
2024/2/18 14:03:38 9KB 88E1111 配置 Verilog
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TMS320F2812DSP2812芯片+外围电路ALTIUMAD集成封装库文件(原理图库+PCB库).IntLib后缀文件,拆分后文件为PcbLib+SchLib格式,AltiumDesigner原理图库+PCB封装库,可以直接应用到你的项目开发加快项目开发进度。
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在日常工作中,钉钉打卡成了我生活中不可或缺的一部分。然而,有时候这个看似简单的任务却给我带来了不少烦恼。 每天早晚,我总是得牢记打开钉钉应用,点击"工作台",再找到"考勤打卡"进行签到。有时候因为工作忙碌,会忘记打卡,导致考勤异常,影响当月的工作评价。而且,由于我使用的是苹果手机,有时候系统更新后,钉钉的某些功能会出现异常,使得打卡变得更加麻烦。 另外,我的家人使用的是安卓手机,他们也经常抱怨钉钉打卡的繁琐。尤其是对于那些不太熟悉手机操作的长辈来说,每次打卡都是一次挑战。他们总是担心自己会操作失误,导致打卡失败。 为了解决这些烦恼,我开始思考是否可以通过编写一个全自动化脚本来实现钉钉打卡。经过一段时间的摸索和学习,我终于成功编写出了一个适用于苹果和安卓系统的钉钉打卡脚本。
2024-04-09 15:03 15KB 钉钉 钉钉打卡