数字逻辑课程设计——数字锁,用VHDL语言描述,在Quartus软件中运行成功,有详细的代码及仿真图
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设计一个简单的数字电子密码锁,密码为4位。
功能:1、密码输入:每按下一个键,要求在数码管上显示,并依次左移;
2、密码清除:清除密码输入,并将输入置为”0000”;
3、密码修改:将当前输入设为新的密码;
4、上锁和开锁包括了所有文件
2024/4/15 13:09:26 502KB 数字密码锁 VHDL 电路设计
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使用VHDL语言描述BPSK的调制与解调,采用DDS技术产生载波,已调通。
2024/4/14 10:01:16 900B BPSK,VHDL
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基于FPGA的奇偶校验码,低密度奇偶校验码 (LDPC)是一种特殊的具有稀疏的奇偶校验矩阵的线性纠错码。
本课题从理论和硬件实现两方面对LDPC码进行讨论研究,最后完成LDPC码的编码设计。
它的直接编码运算量较大,通常具有码长的二次方复杂度.为此,利用有效的校验矩阵 ,来降低编码的复杂度 ,同时研究利用大规模集成电路实现LDPC码的编码,在QuartusⅡ开发平台上,应用VHDL语言实现了有效的编码过程,为LDPC码的硬件实现和实际应用提供依据。
2024/4/2 21:50:14 15KB FPGA代码
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数字调制解调技术在数字通信中占有非常重要的地位,数字通信技术与FPGA的结合是现代通信系统发展的一个必然趋势。
文中介绍了QPSK调制解调的原理,并基于FPGA实现QPSK调制解调电路。
MAX+PLUSII环境下的仿真结果表明了该设计的正确性。
2024/3/31 19:13:45 176KB FPGA QPSK 调制解调电路 vhdl
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7系列的Verilog/VHDL原语使用例程,可用NotePad或UltraEdit等工具打开查看
2024/3/28 12:32:53 172KB Verilog/VHDL 原语
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实现走马灯的VHDL代码。
用两种方法实现,分为顶层、底层
2024/3/28 2:05:49 123KB quartus II ,VHDL ,走马灯
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上升一层2s的电梯,可以修改下面计数器的个数改变时间,再通过waveform看波形不是VHDL等编程语言写的(用元件拼的)
2024/3/25 17:12:27 4.12MB 1
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vhdl语言编写的电子琴和音乐盒二合一功能的音乐发生器,在Quartus5.0下编译下载成功,用的板是啥给忘记了,不过绝对好用,便宜量又足。
祝好运。
2024/3/22 3:31:30 382KB 电子琴 音乐盒 Quartus vhdl
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参考《16位5级流水无cache实验CPU课程设计实验要求》文档及其VHDL代码,在理解其思想和方法的基础上,将其改造成8位的5级流水无cache的实验CPU,包括对指令系统、数据通路、各流水段模块、内存模块等方面的改造。
利用VHDL语言编程实现,并在TEC-CA平台上进行仿真测试。
为方便起见,后续16位5级流水无cache实验CPU简记为ExpCPU-16,而8位的则记为ExpCPU-8。
对于内存模块的改造,参考《计算机组成原理》课程综合实验的方法,独立设计一块8位的RAM。
(1)利用TEC-CA平台上的16位RAM来存放8位的指令和数据;
(2)实现一条JRS指令,以便在符号标志位S=1时跳转。
需要改写ID段的控制信息,并改写IF段;
(3)实现一条CMPJDR,SR,offset指令,当比较的两个数相等时,跳转到目标地址PC+1+offset;
(4)可以探索从外部输入指令,而不是初始化时将指令“写死”在RAM中;
(5)此5段流水模块之间,并没有明显地加上流水寄存器,可以考虑在不同模块间加上流水寄存器;
(6)探索5段流水带cache的CPU的设计。
2024/3/14 23:02:54 2.29MB 华南农业大学 计组实验
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在日常工作中,钉钉打卡成了我生活中不可或缺的一部分。然而,有时候这个看似简单的任务却给我带来了不少烦恼。 每天早晚,我总是得牢记打开钉钉应用,点击"工作台",再找到"考勤打卡"进行签到。有时候因为工作忙碌,会忘记打卡,导致考勤异常,影响当月的工作评价。而且,由于我使用的是苹果手机,有时候系统更新后,钉钉的某些功能会出现异常,使得打卡变得更加麻烦。 另外,我的家人使用的是安卓手机,他们也经常抱怨钉钉打卡的繁琐。尤其是对于那些不太熟悉手机操作的长辈来说,每次打卡都是一次挑战。他们总是担心自己会操作失误,导致打卡失败。 为了解决这些烦恼,我开始思考是否可以通过编写一个全自动化脚本来实现钉钉打卡。经过一段时间的摸索和学习,我终于成功编写出了一个适用于苹果和安卓系统的钉钉打卡脚本。
2024-04-09 15:03 15KB 钉钉 钉钉打卡