vhdl语言f1=3.75kz,f2=1.875kz码宽1.6ms
2025/10/10 5:25:56 869KB fpga fsk调制
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1、单元电路实现,两种实现方式都可以,一:2输入门;
二:复杂CMOS门。
2、由单元电路连接成4位加法器。
3、Chartered0.35工艺。
4、通过波形仿真、DRC、LVS。
首先熟悉cadence软件的使用,练习反相器的原理图和版图绘制,并仿真,运行DRCLVS规则检查。
2025/10/8 20:28:51 885KB 数字芯片设计
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通过波形文件数据,进行MFCC特征提取,做相关滤波、加窗、fft变换等,得到13维mfcc特征,若在13维基础上继续做一阶二阶差分可得到24维mfcc特征
2025/10/5 19:31:23 2.02MB Mfcc /c++
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包含两个文件夹,可生成正弦波,方波,三角波要生成其他波形只需改动一个函数
2025/10/4 9:22:43 9.19MB stm32 波形产生
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用VHDL设计多功能信号发生器,可以产生方波,锯齿波,正弦波,阶梯波等六种波形。
2025/10/2 22:28:22 26KB VHDL
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可控硅单向触发芯片,可以检相、跟随,触发及多种波形输出,如三角波、方波等。
2025/9/27 15:34:14 467KB 可控硅单向触 带角度触发
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PIC18(L)F67K40单片机具有模拟外设、独立于内核的外设和通信外设,并结合了超低功耗(eXtremeLow-Power,XLP)技术,适用于一系列广泛的通用和低功耗应用。
这些64引脚器件配备了10位带计算功能的ADC(ADCwithComputation,ADCC),支持自动电容分压器(CapacitiveVoltageDivider,CVD)技术,可用于高级触摸传感、平均、滤波、过采样和执行自动阈值比较。
此外,它们还提供一组独立于内核的外设,例如互补波形发生器(ComplementaryWaveformGenerator,CWG)、窗口看门狗定时器(WindowedWatchdogTimer,WWDT)、循环冗余校验(CyclicRedundancyCheck,CRC)/存储器扫描、过零检测(Zero-CrossDetect,ZCD)和外设引脚选择(PeripheralPinSelect,PPS),用于提高设计灵活性和降低系统成本
2025/9/27 13:37:39 10.57MB PIC18(L)F67K
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雷达测量精度:雷达测量单个目标参数的准确程度,它与许多因素有关,比如雷达系统本身的完善性、电波传播等,这里只讨论噪声存在下,雷达能给出的最大测量精度。
雷达分辨力:雷达能从两个或者两个以上目标中区分特定目标的能力。
它与雷达本身的特性、目标特性等,这里只研究与雷达发射波形有关的固有分辨力。
2025/9/27 7:54:27 53KB 测距、测速 精度、分辨力
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EDA技术在电子系统设计领域越来越普及,本设计主要利用VHDL语言在EDA平台上设计一个电子数字钟,它的计时周期为24小时,显示满刻度为23时59分59秒,另外还具有校时功能和闹钟功能。
总的程序由几个各具不同功能的单元模块程序拼接而成,其中包括分频程序模块、时分秒计数和设置程序模块、比较器程序模块、三输入数据选择器程序模块、译码显示程序模块和拼接程序模块。
并且使用QuartusII软件进行电路波形仿真,下载到EDA实验箱进行验证。
该设计采用自顶向下、混合输入方式(原理图输入—顶层文件连接和VHDL语言输入—各模块程序设计)实现数字钟的设计、下载和调试。
2025/9/21 15:19:19 528KB FPGA,数字钟
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对信号进行抽样、量化和A律PCM编码,经过传输后,接收端进行PCM译码。
要求画出不同幅度下PCM编码、译码后的波形以及未编码波形。
2025/9/20 6:11:44 1KB pcm
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在日常工作中,钉钉打卡成了我生活中不可或缺的一部分。然而,有时候这个看似简单的任务却给我带来了不少烦恼。 每天早晚,我总是得牢记打开钉钉应用,点击"工作台",再找到"考勤打卡"进行签到。有时候因为工作忙碌,会忘记打卡,导致考勤异常,影响当月的工作评价。而且,由于我使用的是苹果手机,有时候系统更新后,钉钉的某些功能会出现异常,使得打卡变得更加麻烦。 另外,我的家人使用的是安卓手机,他们也经常抱怨钉钉打卡的繁琐。尤其是对于那些不太熟悉手机操作的长辈来说,每次打卡都是一次挑战。他们总是担心自己会操作失误,导致打卡失败。 为了解决这些烦恼,我开始思考是否可以通过编写一个全自动化脚本来实现钉钉打卡。经过一段时间的摸索和学习,我终于成功编写出了一个适用于苹果和安卓系统的钉钉打卡脚本。
2024-04-09 15:03 15KB 钉钉 钉钉打卡