用altera的CYClone系列的fpga，verilog写的代码，可以分离出LCD显示字符和变量（频率值）的程序，用的是AD9226,12位AD，可以精确测量，经调试可测频率高达100MHZ，误差小于0.01.
2023/12/15 10:02:33
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本资源为CMI和HDB3的编译码在Quartus_28.0下的代码，FPGA芯片型号是（Cyclone-EP1C3T144C8）将资源下载后放到D盘根目录下解压即可，其中pn目录下为pn序列模块的产生（含VHDL正确的源代码，详细的注释，波形仿真文件与图还有生成的原理图模块）；
bm目录下为CMI/HDB3的编码模块（含VHDL正确的源代码，详细的注释，波形仿真文件与图还有生成的原理图模块）；
ym目录下为CMI/HDB3的译码模块（含VHDL正确的源代码，详细的注释，波形仿真文件与图还有生成的原理图模块）；
cmiall目录下为CMI/HDB3的整个编译码整个系统（整个系统的原理图文件，已经连接好，下载到FPGA调试通过，观察到pn序列CMI/DB3译码前后示波器观察的波形正确无误），资源还含有实验结果示波器拍摄对比图，本资源相当有参考价值，希望对大家有帮助！
bm目录下为CMI/HDB3的编码模块（含VHDL正确的源代码，详细的注释，波形仿真文件与图还有生成的原理图模块）；
ym目录下为CMI/HDB3的译码模块（含VHDL正确的源代码，详细的注释，波形仿真文件与图还有生成的原理图模块）；
cmiall目录下为CMI/HDB3的整个编译码整个系统（整个系统的原理图文件，已经连接好，下载到FPGA调试通过，观察到pn序列CMI/DB3译码前后示波器观察的波形正确无误），资源还含有实验结果示波器拍摄对比图，本资源相当有参考价值，希望对大家有帮助！
2023/11/8 19:35:57
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EP1C6_RTL8208B_TFP410_DVI分配器protel硬件原理图+PCB文件，采用4层板设计，板子大小为178x117mm，双面布局布线，FPGA芯片选用cyclone系列中的EP1C6Q240，PHY芯片选用RTL8208B,网口变压器为H1102，DVI接口芯片TFP410。
电源芯片LM1085IT-ADJ。
Protel99se设计的DDB后缀项目工程文件，包括完整无措的原理图及PCB印制板图，可用Protel或AltiumDesigner(AD)软件打开或修改，已经制板并在实际项目中使用，可作为你产品设计的参考。
电源芯片LM1085IT-ADJ。
Protel99se设计的DDB后缀项目工程文件，包括完整无措的原理图及PCB印制板图，可用Protel或AltiumDesigner(AD)软件打开或修改，已经制板并在实际项目中使用，可作为你产品设计的参考。
2023/5/15 18:34:24
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CycloneV系列中文数据手册，本章节介绍了Cyclone®V中间架构中逻辑阵列模块(LAB)的成果特色。
LAB是由称作自顺应逻辑模块(ALM)的底子结构模块组成,经由配置配备枚举这些模块能够实现逻辑成果、算术成果以及寄存器成果。
您能够将CycloneV器件中1/4的LAB用作存储器LAB(MLAB)。
Quartus®II软件以及所反对于的第三方综合货物，与参数化成果(譬如参数化模块库(LPM))一起，对于罕用成果(譬如:计数器、加法器、减法器以及算术成果)自动遴选响应的方式。
LAB是由称作自顺应逻辑模块(ALM)的底子结构模块组成,经由配置配备枚举这些模块能够实现逻辑成果、算术成果以及寄存器成果。
您能够将CycloneV器件中1/4的LAB用作存储器LAB(MLAB)。
Quartus®II软件以及所反对于的第三方综合货物，与参数化成果(譬如参数化模块库(LPM))一起，对于罕用成果(譬如:计数器、加法器、减法器以及算术成果)自动遴选响应的方式。
2023/4/30 6:52:26
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在QuartusII软件平台的底子上，基于VHDL语言及图形输入，付与FPGA方案了一款数字秒表，同时，给出了数字秒表体系方案方案及各个成果模块的方案原理。
经由对于体系举行编译、仿真，并下载到Cyclone系列EP2C5Q208C8器件中举行测试，下场评释，本方案能实现计时展现、启停、复位及计时溢出报警成果。
经由对于体系举行编译、仿真，并下载到Cyclone系列EP2C5Q208C8器件中举行测试，下场评释，本方案能实现计时展现、启停、复位及计时溢出报警成果。
2023/4/8 8:39:56
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基于FPGA的应用技术，采用Altera公司DE2-70开发板的CycloneⅡ系列EP2C70作为核心器件，设计了一种基于FPGA的新型可调信号发生器。
通过QuartusⅡ软件及VerilogHDL编程语言设计LPM_ROM模块定制数据ROM，并通过地址指针读取ROM中不同区域的数据，根据读取数据间隔的不同，实现调整频率功能，该系统可产生正弦波、方波、三角波和锯齿波4种波形信号，并使用嵌入式逻辑分析仪对产生的不同波形信号进行实时测试，实验证明，该可调信号发生器系统软件模仿数据和理论定制波形相吻合。
通过QuartusⅡ软件及VerilogHDL编程语言设计LPM_ROM模块定制数据ROM，并通过地址指针读取ROM中不同区域的数据，根据读取数据间隔的不同，实现调整频率功能，该系统可产生正弦波、方波、三角波和锯齿波4种波形信号，并使用嵌入式逻辑分析仪对产生的不同波形信号进行实时测试，实验证明，该可调信号发生器系统软件模仿数据和理论定制波形相吻合。
2022/10/11 13:39:49
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Quartus高版本缺少的编译库，当编译特定的工程时，需求添加该库文件-cyclone_iii元器件库，否则会报错！
2021/4/15 19:27:46
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在日常工作中，钉钉打卡成了我生活中不可或缺的一部分。然而，有时候这个看似简单的任务却给我带来了不少烦恼。
每天早晚，我总是得牢记打开钉钉应用，点击"工作台"，再找到"考勤打卡"进行签到。有时候因为工作忙碌，会忘记打卡，导致考勤异常，影响当月的工作评价。而且，由于我使用的是苹果手机，有时候系统更新后，钉钉的某些功能会出现异常，使得打卡变得更加麻烦。
另外，我的家人使用的是安卓手机，他们也经常抱怨钉钉打卡的繁琐。尤其是对于那些不太熟悉手机操作的长辈来说，每次打卡都是一次挑战。他们总是担心自己会操作失误，导致打卡失败。
为了解决这些烦恼，我开始思考是否可以通过编写一个全自动化脚本来实现钉钉打卡。经过一段时间的摸索和学习，我终于成功编写出了一个适用于苹果和安卓系统的钉钉打卡脚本。
2024-04-09 15:03
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