FPGA_W5500源码

W5500 FPGA Verilog

FPGA_W5500源码
W5500的verilog驱动代码，包括初始化FSM，SPI传输，适当修正后可用于工程实践。

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评论信息

lmyapple:

不错的资料2020-05-14
lmyapple:

不错的资料2020-05-14
m0_46387752:

您好，想问一下MAC地址应该是6个字节，但您在FSM模块中定义的是固定数据长度4个字节，不能写全，请问该怎么改2020-03-27
昵称妮妮:

您好，想问一下MAC地址应该是6个字节，但您在FSM模块中定义的是固定数据长度4个字节，不能写全，请问该怎么改2020-03-27
yangtianbo:

你好，问一下，pool_e_num[2:0]这个传递的是什么值,还有就是那个fifo块的作用是什么，去掉的话有问题吗？2020-02-04
@YTB:

你好，问一下，pool_e_num[2:0]这个传递的是什么值,还有就是那个fifo块的作用是什么，去掉的话有问题吗？2020-02-04
weixin_42671565:

有一个下载抄袭这个代码，代码里面的命名比较奇怪，无法领会2019-05-25
weixin_42671565:

有一个下载抄袭这个代码，代码里面的命名比较奇怪，无法领会2019-05-25
qq_42376254:

想问下top文件中的show和spi_div是什么？2019-04-25
simonlok082:

想问下top文件中的show和spi_div是什么？2019-04-25

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