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反相器链缓冲器级数和尺寸优化,D触发器设计及输出延时优化
上传者:
jajupmochiwxxz
|
上传时间:2024/5/16 19:18:51
|
文件大小:1.41MB
|
文件类型:doc
反相器
D触发器
设计优化
hspice
反相器链缓冲器级数和尺寸优化,D触发器设计及输出延时优化
VLSI设计和优化问题,包括两个内容:反相器链缓冲器级数和尺寸优化,D触发器设计及输出延时优化。
使用hspice网格形式设计优化,文档内代码可直接使用。
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资源详情
器级数和尺寸优化,D触发器设计及输出延时优化-cite-
评论信息
xiaoyiqing007:
没多大用处
2018-09-11
yongli2008:
很简单,已成功实现了!谢谢!
2018-06-24
todkee:
实验报告,用处不大
2014-07-02
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