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用VerilogHDL语言编写的基于FBGA的四位数字式秒表

上传者: qq_34331129 | 上传时间:2023/3/26 3:46:22 | 文件大小:4.68MB | 文件类型:zip
用VerilogHDL语言编写的基于FBGA的四位数字式秒表
秒表输入的值展现规模为00.00~99.99,高位在前,低位在后,数码管展现需要经由BCD-七段数码管编译(实际法度圭表标准编写的是八段的数码管——即加之)。
上电后,展现0000,行使两个按钮S一、S2抑制计时。
法度圭表标准是经由教师的试验箱测试过的,能够实现秒表的底子成果

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