PIC16F151X和PIC16LF151X器件：高功能RISCCPU：•优化的C编译器架构•仅需学习49条指令•可寻址最大28KB的线性程序存储空间•可寻址最大1024字节的线性数据存储空间•工作速度：-DC–20MHz时钟输入（2.5V时）-DC–16MHz时钟输入（1.8V时）-DC–200ns指令周期•带有自动现场保护的中断功能•带有可选上溢/下溢复位的16级深硬件堆栈•直接、间接和相对寻址模式：-两个完全16位文件选择寄存器（FileSelectRegister，FSR）-FSR可以读取程序和数据存储器灵活的振荡器结构：•16MHz内部振荡器模块：-可通过软件选择频率范围：31kHz至16MHz•31kHz低功耗内部振荡器•外部振荡器模块具有：-4种晶振/谐振器模式，频率最高为20MHz-3种外部时钟模式，频率最高为20MHz•故障保护时钟监视器（Fail-SafeClockMonitor，FSCM）-当外设时钟停止时可使器件安全关闭•双速振荡器启动•振荡器起振定时器（OscillatorStart-upTimer，OST）模拟特性：•模数转换器（Analog-to-DigitalConverter，ADC）：-10位分辨率-最多28路通道-自动采集功能-可在休眠模式下进行转换•参考电压模块：-具有1.024V、2.048V和4.096V输出的固定参考电压（FixedVoltageReference，FVR）•温度指示器采用nanoWattXLP的超低功耗管理PIC16LF151X：•休眠模式：20nA（1.8V时，典型值）•看门狗定时器：300nA（1.8V时，典型值）•辅助振荡器：600nA（32kHz时）单片机特性：•工作电压范围：-2.3V-5.5V（PIC16F151X）-1.8V-3.6V（PIC16LF151X）•可在软件控制下自编程•上电复位（Power-onReset，POR）•上电延时定时器（Power-upTimer，PWRT）•可编程低功耗欠压复位（Low-PowerBrown-OutReset，LPBOR）•扩展型看门狗定时器（WatchdogTimer，WDT）•通过两个引脚进行在线串行编程（In-CircuitSerialProgramming™，ICSP™）•通过两个引脚进行在线调试（In-CircuitDebug，ICD）•增强型低电压编程（Low-VoltageProgramming，LVP）•可编程代码保护•低功耗休眠模式•低功耗BOR（LPBOR）外设特点：•最多35个I/O引脚和1个仅用作输入的引脚：-高灌/拉电流：25mA/25mA-可单独编程的弱上拉-可单独编程的电平变化中断（Interrupt-On-Change，IOC）引脚•Timer0：带有8位预分频器的8位定时器/计数器•增强型Timer1：-带有预分频器的16位定时器/计数器-外部门控输入模式-低功耗32kHz辅助振荡器驱动器•Timer2：带有8位周期寄存器、预分频器和后分频器的8位定时器/计数器•两个捕捉/比较/PWM（Capture/Compare/PWM，CCP）模块：•带有SPI和I2CTM的主同步串行口（MasterSynchronousSerialPort，MSSP）：-7位地址掩码-兼容SMBus/PMBusTM•增强型通用同步/异步收发器（EnhancedUniversalSynchronousAsynchronousReceiverTransmitter，EUSART）模块：-兼容RS-232、RS-485和LIN-自动波特率检测-接收到启动位时自动唤醒

第1章概述 31.1SOC与SOPC技术简介 31.1.1SOC单片系统 31.1.2SOPC及其技术 31.2嵌入式系统简介 31.2.1嵌入式系统的概念与组成 31.2.2嵌入式系统的特点与应用 31.2.3嵌入式系统的发展趋势 3第2章FPGA设计基础 42.1QuartusII综述 42.1.1软件特点 42.1.2用户界面 42.2QuartusII设计流程 72.3流水灯的FPGA设计 82.4使用嵌入式逻辑分析仪进行实时测试 162.5FPGA内部存储器设计 202.6嵌入式锁相环altPLL宏功能模块调用 24第3章优化设置与时序分析 273.1Setting设置 273.2时序设置与分析 273.3分析结果查看 27第4章第三方EDA工具 284.1概述 284.2仿真工具ModelSim的使用 284.3ModelSim和QuartusⅡ联合使用 40第5章基于FPGA的DSP开发技术 415.1Matlab/DSPbuilder及其设计流程 415.2DSPBuilder的安装与注册 425.3基于MATLAB/Simulink模块的FIR滤波器设计与仿真 425.3基于IP核的FIR滤波器设计与仿真 54第6章SOPC设计基础 586.1NiosII处理器结构 586.2Avalon总线规范 696.3NiosII硬件开发 1056.4NiosII软件开发 1236.5HAL系统库 142第7章NiosII外设及其编程 1437.1PIO 1447.2UART 1497.3定时器 1557.4片内存储器 1597.5SDRAM控制器 1597.6Flash 1637.7DMA控制器 1637.8SPI 1687.9简单NIOSII系统建立 173第8章NiosII深入设计 1748.1定制NiosII用户指令 1748.2自定义Avalon从组件 1838.3NiosII多处理器系统 1838.4中缀处理 183

C2000，此处具体是TMS320F28035的数据手册大全具体包含MCU数据手册，及MCU相关外设数据手册包含ePWM,CLA等等，还包含有寄存器手册紧缩包内涵的pdf都有标签

学习STM32F2系列必备资料，了解各外设的功能参数

NXPiMX6CORTEX-A9TinyRex外设开发底板AD设计硬件原理图+PCB(6层)+封装库+BOM文件，采用6层板设计，板子大小为80x90mm，双面规划布线。
主要器件为H5007NLTS3USB221ERSER28.63636MHzADV7610BBCZ-PSI4425BDY-T1-E3MMBT3906,215等。
AltiumAD设计硬件原理图+PCB工程文件，ad设计的工程文件，包括原理图及PCB印制板图，可以用AltiumDesigner(AD)软件打开或修改，可作为你产品设计的参考。

基于嵌入式STM32的嵌入式开辟，作品原型为智能风扇，包括LED、蜂鸣器、风扇、LCD等外设的源程序!

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KinetisKE0x家族是KinetisE系列的入门级产品与整个E系列和8位S08P家族引脚兼容本家族包含一系列功能强大的模拟通信定时和控制外设提供各种闪存尺寸和引脚数此外这个系列特别适合入门级解决方案所需求的高耐用性经济高效和节能的MCU总而言之本组产品是新一代MCU解决方案在低成本中提供更高的ESD/EMC功能在高噪声环境中保持着高可靠性

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摘　　要随着通信、计算机网络等技术的飞速发展,语音压缩编码技术得到了快速发展和广泛应用。
尤其是最近20年，语音压缩编码技术在移动通信、卫星通信、多媒体技术以及IP电话通信中得到普遍应用，起着举足轻重的作用。
人们相互交流的信息量也在不断地急剧增加，庞大的语音信号数据给存储和传输带来了巨大的的压力，使得信道资源变得愈加宝贵。
因而，语音压缩和语音编码技术显得越来越重要。
本课题是基于DSP的G.711语音压缩算法设计与实现，通过DSP将采集到的语音信号进行G.711压缩算法的处理。
最后通过外设输出压缩后的语音信号。
最终实现语音信号的采集、压缩与回放。
本论文根据系统的功能需求，完成了该系统的算法研究，软硬件的设计。
设计出了A律编解码的软件流程框图，在以TMS320VC5502为处理器的硬件开发平台上实现了语音信号的A律压缩解压算法，并给出了压缩程序流程图。
目　　录摘　　要 1Abstract 2引言 31绪论 11.1课题的背景 11.2课题的意义 21.3语音压缩编解码概述 42语音压缩的理论依据与算法 52.1语音压缩的理论依据 52.2语音信号产生的数字模型 62.3语音压缩的算法 82.3.1G.711语音编码标准 82.3.2PCM编码 82.3.3A律压扩标准 93系统的硬件设计 123.1电源电路 133.2复位电路 143.3时钟电路 153.4JTAG电路 153.5语音采集电路 173.6SDRAM电路 183.7FLASH扩展电路 194系统的软件设计 224.1总体程序设计 224.2语音编解码程序设计 234.3程序的调试 24结　　论 25参考文献 26附录A硬件电路图 27附录B源程序清单 28致　　谢 43

在日常工作中，钉钉打卡成了我生活中不可或缺的一部分。然而，有时候这个看似简单的任务却给我带来了不少烦恼。 每天早晚，我总是得牢记打开钉钉应用，点击"工作台"，再找到"考勤打卡"进行签到。有时候因为工作忙碌，会忘记打卡，导致考勤异常，影响当月的工作评价。而且，由于我使用的是苹果手机，有时候系统更新后，钉钉的某些功能会出现异常，使得打卡变得更加麻烦。 另外，我的家人使用的是安卓手机，他们也经常抱怨钉钉打卡的繁琐。尤其是对于那些不太熟悉手机操作的长辈来说，每次打卡都是一次挑战。他们总是担心自己会操作失误，导致打卡失败。 为了解决这些烦恼，我开始思考是否可以通过编写一个全自动化脚本来实现钉钉打卡。经过一段时间的摸索和学习，我终于成功编写出了一个适用于苹果和安卓系统的钉钉打卡脚本。