/ 从Simulink模型自动生成VHDL代码——基于DSPBuilder的FPGA设计流程
从Simulink模型自动生成VHDL代码——基于DSPBuilder的FPGA设计流程
从Simulink模型自动生成VHDL代码——基于DSPBuilder的FPGA设计流程
介绍了基于Altera提供的DSPBuilder开发工具从Simulink模型自动生成VHDL代码的一种新的FPGA设计流程，并基于此流程实现了一个7阶FIR数字低通滤波器。
本软件ID:1953194
介绍了基于Altera提供的DSPBuilder开发工具从Simulink模型自动生成VHDL代码的一种新的FPGA设计流程，并基于此流程实现了一个7阶FIR数字低通滤波器。
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fuzi0001:高级的应用，可以有助于理解和提升VHDL代码的自动生产。2021-06-16 -
xoyi76:非常好！值得一看！2020-12-31
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QAZWSX58963:比较详细，十分有用2014-05-30
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hangfei1111:设计了一个滤波器，中间遇到点问题，后来解决了，还是比较详细的2014-03-01
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DYPCQ:比较详细，实现了一个7阶FIR数字低通滤波器2012-10-02
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