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Verilog语言方案单周期MIPSCPU(42条指令)

上传者: weixin_42213570 | 上传时间:2023/4/22 6:04:57 | 文件大小:269KB | 文件类型:zip
Verilog语言方案单周期MIPSCPU(42条指令)
试验内容(ISA2新增3条指令)•用硬件描摹语言(Verilog)方案MIPSCPU,反对于如下指令集•ISA1={ADD/ADDU/SUB/SUBU/SLL/SRL/SRA/SLLV/SRLV/SRAV/AND/OR/XOR/NOR/SLT/SLTU/ADDI/ADDIU/ANDI/ORI/XORI/LUI/SLTI/SLTIU/LB/LBU/LH/LHU/LW/SB/SH/SW/BEQ/BNE/BGEZ/BGTZ/BLEZ/BLTZ/J/JAL/JR/JALR}42条•ISA2={add,sub,addu,subu,addi,ori,lui,and,andi,or,nor,slt,sltu,sll,srl,sllv,srlv,lw,sw,beq,bne,j,jal,jr}24条•用仿真软件Modelsim对于有数据冒险以及抑制冒险的汇编法度圭表标准举行仿文件搜罗源代码以及试验报告。
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[{"title":"(15个子文件269KB)Verilog语言设计单周期MIPSCPU(42条指令)","children":[{"title":"MIPSCPU设计实验报告.doc <span style='color:#111;'>453.50KB</span>","children":null,"spread":false},{"title":"mips_cpu","children":[{"title":"Test_42_Instr.dat <span style='color:#111;'>860B</span>","children":null,"spread":false},{"title":"ctrl_encode_def.v <span style='color:#111;'>706B</span>","children":null,"spread":false},{"title":"sccomp_tb(1).v <span style='color:#111;'>2.81KB</span>","children":null,"spread":false},{"title":"EXT.v <span style='color:#111;'>244B</span>","children":null,"spread":false},{"title":"ctrl.v <span style='color:#111;'>6.57KB</span>","children":null,"spread":false},{"title":"dm.v <span style='color:#111;'>2.62KB</span>","children":null,"spread":false},{"title":"NPC.v <span style='color:#111;'>703B</span>","children":null,"spread":false},{"title":"mux.v <span style='color:#111;'>2.39KB</span>","children":null,"spread":false},{"title":"PC.v <span style='color:#111;'>288B</span>","children":null,"spread":false},{"title":"sccpu.v <span style='color:#111;'>4.10KB</span>","children":null,"spread":false},{"title":"RF.v <span style='color:#111;'>1.30KB</span>","children":null,"spread":false},{"title":"alu.v <span style='color:#111;'>2.09KB</span>","children":null,"spread":false},{"title":"im.v <span style='color:#111;'>170B</span>","children":null,"spread":false},{"title":"sccomp.v <span style='color:#111;'>1.65KB</span>","children":null,"spread":false}],"spread":false}],"spread":true}]

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