/ 可综合的verilog编写的RISC_CPU设计
可综合的verilog编写的RISC_CPU设计
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一个简单的用verilog语言描述的RISC_CPU的例子，这个例子结构简单，对于初学者很有用 本软件ID:4826673
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u014706926:讲的很清楚，有代码，有讲解，很好的资料。2014-04-29 -
尘恩cj:讲的很清楚，有代码，有讲解，很好的资料。2014-04-29
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lhlhit163:不错，信息挺全面2013-01-09
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zhh_ak47:夏宇闻《verilog数字设计教程》中的内容2012-12-22
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sanger0201:没记错的话这是夏老师FPGA一章节里的内容，不过有电子版的话适合把代码黏过来，很不错2012-12-06
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秋山老雷:没记错的话这是夏老师FPGA一章节里的内容，不过有电子版的话适合把代码黏过来，很不错2012-12-06
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