数字逻辑之数字时钟课程设计设计要求1、设计一个能显示日期、小时、分钟、秒的数字电子钟,并具有整点报时的功能。
 2、可手动校正时、分时间和日期值,时间以24小时为一个周期,有校时功能,可以分别对时及分进行单独校时,使其校正到标准时间;
3、计时过程具有报时功能,当时间到达整点前10秒进行蜂鸣报时;
 为了保证计时的稳定及准确须由晶体振荡器提供表针时间基准信号由晶振电路产生1HZ标准的信号,分、秒为六十进制计数器,时为二十四进制计数器。
2025/6/10 2:04:22 633KB 数字逻辑设计报告
1
GSM呼叫流程图移动台的呼入接续过程:1、寻呼。
MSC/VLR在数据库中查出用户的资料并向相关的BSC发送寻呼信息。
该信息包含用户所在区域的LAI和用户的IMSI或者TMSI。
2、寻呼命令。
BSC向LA区内的所有BTS发出寻呼命令。
该信息包含IMSI或TMSI。
收发信单元识别码、信道类型和时隙号。
3、寻呼请求。
BTS在PCH上向移动台发送寻呼信息。
该信息包含用户的IMSI或TMSI。
4、信道请求。
被寻呼的移动台在RACH上发送一个短的接入脉冲串至BTS。
BTS接收该寻呼响应信号后记录该突发脉冲串的迟滞值。
(TA动态PWR)5、信道请求。
BTS向BSC发信道请求信息。
该信息还包含移动台接入系统的迟滞值(TA.PWR)。
6、信道激活。
BSC选择一条空闲的SDCCH并指示BTS激活该信道。
7、信道激活证实。
BTS激活SDCCH后向BSC发信道激活证实信息。
8、立即分配。
BSC透过BTS经由AGCH向移动台发出允许接入系统信息。
该信息包含频率、时隙号、SDCCH信道号和移动台将要使用的时间提前值TA等。
9、寻呼响应。
移动台通过SDCCH向BSC发寻呼响应信息。
该信息包含移动台的IMSI或TMSI和移动台的等级标记,BSC加入CGI后把信息送往MSC/VLR。
10、鉴权请求。
MSC/VLR透过BSC、BTS向移动台发鉴权请求,其中包含随机数RAND,用移动台的鉴权运算。
11、鉴权响应。
移动台经鉴权计算后向MSC/VLR发回鉴权响应信息,MSC/VLR检查用户全法性,如用户全法,则开始启动加密程序。
12、加密模式命令。
MSC/VLR通过BSC、BTS向移动用户发加密模式命令。
该命令在SDCCH上传送。
13、加密模式完成。
移动台进行加密运算后向BTS发出已加密的特定信号,BTS解密成功后透过BSC向MSC/VLR发加密模式完成信息。
14、设置呼叫类型。
MSC向移动台发送呼叫类型设置信息。
该信息包含该次呼叫的类型。
如传真、通话或数据通信等类型。
15、呼叫类型证实。
移动台设置好呼叫类型后向MSC发出呼叫类型证实信息。
16、分配请求。
MSC要求BSC选择一条通往移动台的话音信道,同时MSC在一条通往BSC的PCM上选择一个空闲时隙,并把时隙的电路识别码CIC送往BSC。
17、信道激活。
如果BSC发现某小区上有一条空闲的TCH,它将向BTS发送信道激活命令。
18、信道激活证实。
BTS激活TCH后向BSC发回信道激活证实信息。
19、分配命令。
BSC通过SDCCH向移动台发信道切换指令,命令移动台切换至所指定的TCH。
20、分配完成。
移动台切换至所指定的TCH后向BSC发送信道分配完成信息,BSC接收后再送往MSC/VLR。
21、无线频率信道释放/释放证实。
BSC释放SDCCH信道并把它标记为空闲状态。
22、振铃回应。
当移动台开始振铃时移动台要向MSC发送一个通知信息。
23、连接。
当移动台摘机应答时,移动台向MSC发送一个连接信息,MSC把移动台的电路接通,开始通话。
1
提出一种用于测量微结构表面形貌的离轴显微干涉术。
该技术的实验装置为一个优化的马赫-曾德尔干涉仪。
其特点为参考波是具有一定载频的倾斜波。
该技术中应用CCD记录离轴显微干涉图,并用傅里叶变换方法对记录的干涉图在傅里叶面进行频谱滤波求解相位。
不同于经典显微干涉术,离轴显微干涉图的载频较高,仅需单幅干涉图即可得到相位信息。
因此该技术在测量中具有防振、快捷有效的特点。
利用一个标准微台阶以及微孔阵列的形貌检测结果验证该技术的有效性,同时与轮廓仪的测试结果进行对比,证明结果一致。
被测物也应用Mirau干涉显微镜进行测试,实验结果表明经典显微干涉图干涉信息载频不足,仅使用单幅干涉图不能得到正确相位,该组实验证明了离轴显微干涉术相对于传统显微干涉术的优越性。
2025/6/7 7:53:11 3.55MB 测量 表面形貌 离轴 载频
1
晶振晶振封装AltiumDesignerADPCB封装库2D3D元件库文件,PcbLib格式,包括38个封装文件,AltiumDesigner的2D3D三维PCB封装库,3D视图库,AD库,均经测试,可以直接应用到你的项目开发。
1
在做许多动网格问题当中,经常会遇到因为网格质量不是很高,经过运动变形后出现负体积,导致计算无法正常进行从而发散的现象。
ANSYS在17.0版本之后推出Overset技术,旨在解决出现负体积问题。
该篇主要分为技术实现及项目桥梁主动颤振计算两个部分。
资源中涵盖了具体的UDF,以及激活Fluent中Overset的方法,另外还提供了一个双桥面强迫振动的算例及完成后生成的动画,希望对相关研究方向的硕士生有所帮助。
另外留下了我Q联系方式,有问题的可以请教。
1
1绪论41.1课题背景41.2智能家居控制系统的概述51.3课题研究的目的及意义61.4系统设计主要任务62方案设计72.1系统总体设计与分析72.1.1单片机控制部分72.1.2系统工作流程部分82.2远程控制设计与分析82.2.1控制系统设计分析82.2.2控制要求92.2.3单元功能模块92.3传感器信号采集设计与分析92.3.1防火灾发生传感器92.3.2可燃气体泄漏传感器102.3.3防盗传感器102.3.4信号采集设计与分析102.4GSM模块的接口与设计102.4.1TC35模块组成102.4.2TC35模块通信电路102.4.3TC35模块与MCU连接方式102.5红外学习遥控设计112.5.1红外学习遥控的设想112.5.2红外学习遥控的实现113硬件电路设计123.1相关芯片及模块简介123.1.1MCUSM8952AC25P简介123.1.2双音多频收发器MT8870简介123.1.3ISD2500系列单片语音录放简介133.1.4固态继电器(SSR)简介133.2远程控制电路设计133.2.1振铃检测电路133.2.3双音频解码电路153.2.4语言提示电路163.3电源电路设计173.3.15V开关电源稳压器电路173.3.2其他电源稳压器电路173.4TC35短消息模块电路设计173.4.1TC35短消息模块接口电路173.4.2TC35短消息模块控制设计183.5红外学习遥控电路设计193.5.1红外学习遥控接收电路设计193.5.2红外学习遥控发送电路设计194软件部分194.1下位机编程194.1.1主控单片机系统软件设计194.1.2远程控制程序设计214.1.3短信息发送程序设计224.1.4红外学习遥控程序设计234.2上位机(PC机)编程244.2.1用户界面的设计244.2.2串行通信的实现244.2.3控件MSComm使用方法255系统制作及调试265.1使用的仪器仪表及工具275.2硬件制作与调试275.2.1系统PCB板的设计275.2.2系统硬件调试275.3软件及联机调试285.3.1主控程序调试285.3.2短消息发送调试286结论29
1
使用USB虚拟串口与PC通讯的DEMO(USB——CDC/VCP)工程模板开发平台:keil5硬件要求:STM32F407VG具有usart1,以及使用PA11和PA12的USB接口,外部晶振8M本人硬件调试通过,使用方法见文档注意:本DEMOusb串口不是使用回显的方法,无论你发什么到usb串口,他都会回你helloworld,另一个硬件的usart1串口可以看到你在usb串口上发送的字符
2025/5/26 5:16:10 11.77MB USB_CDC USB_VCP
1
基于STM32F103的步进电机(ULN2003/28BYJ-48)角度和转速控制驱动代码,完整工程代码,采用12MHz外部晶振!
2025/4/19 14:11:43 8.99MB stm32f103 步进电机 角度 转速
1
使用STM32F4搭配OV7670的拍照代码,0V7670不含晶振和FIFO
2025/4/16 17:51:45 44.94MB stm32 fifo 单片机
1
VerilogGoldenReferenceGuide.pdf(270.43KB)VerilogGolden中文版.pdf(511.67KB)VerilogHDL代码描述对状态机综合的研究.doc(74.5KB)Veriloghdl教程135个经典设计实例(王金明).rar(191.15KB)VerilogHDL数字设计与综合.pdf(1.06MB)Verilog电梯控制器设计.doc(106KB)VerilogHDL硬件描述语言(averilogHDLprimer译本)(美)J.Bhasher著徐振林等译.zip(4.55MB)Verilog非阻塞赋值的仿真综合问题.doc(132KB)Verilog脉冲发生器程序.doc(22KB)VerilogHDL综合实用教程.pdf(2.62MB)VerilogHDL的基础知识.pdf(316.61KB)Verilog的键盘源码keypad—有去抖功能.doc(28.5KB)verilog的阻塞和非阻塞赋值.doc(80KB)Verilog交通灯控制器程序.doc(23KB)Verilog黄金参考指南.pdf(511.67KB)Verilog例子代码.zip(8.49KB)Verilog设计代码.zip(367.71KB)Verilog数字系统设计示例.rar(41.25KB)Verilog语言练习与讲解(中文).pdf(432.87KB)Verilog语言练习与讲解(中文补充).pdf(114.08KB)东南大学Verilog讲义.zip(581.83KB)关于verilog综合小结.doc(27KB)华为:VerilogHDL入门教程.pdf(280.97KB)卡内基梅陇大学verilog课程讲义.pdf(294.37KB)可综合的Verilog语法(剑桥大学,影印).pdf(412.39KB)清华微电子所verilog课件.rar(110.82KB)王金明:《VerilogHDL程序设计教程》及相关源码.rar(10.52MB)硬件描述语言Verilog(第四版).pdf(5.45MB)浙大VerilogHDL.zip(7.35MB)
2025/4/8 11:30:36 35.08MB Verilog
1
共 204 条记录 首页 上一页 下一页 尾页
在日常工作中,钉钉打卡成了我生活中不可或缺的一部分。然而,有时候这个看似简单的任务却给我带来了不少烦恼。 每天早晚,我总是得牢记打开钉钉应用,点击"工作台",再找到"考勤打卡"进行签到。有时候因为工作忙碌,会忘记打卡,导致考勤异常,影响当月的工作评价。而且,由于我使用的是苹果手机,有时候系统更新后,钉钉的某些功能会出现异常,使得打卡变得更加麻烦。 另外,我的家人使用的是安卓手机,他们也经常抱怨钉钉打卡的繁琐。尤其是对于那些不太熟悉手机操作的长辈来说,每次打卡都是一次挑战。他们总是担心自己会操作失误,导致打卡失败。 为了解决这些烦恼,我开始思考是否可以通过编写一个全自动化脚本来实现钉钉打卡。经过一段时间的摸索和学习,我终于成功编写出了一个适用于苹果和安卓系统的钉钉打卡脚本。
2024-04-09 15:03 15KB 钉钉 钉钉打卡