《ADS应用详解——射频电路设计与仿真》【作者】陈艳华李朝晖夏玮【编辑】刘浩【ISBN】978-7-115-18407-8介绍使用ADS进行射频电路设计和仿真的基础知识和方法。
内容涉及射频电路的基础理论、ADS的基本概况以及ADS各种仿真功能,书中完整地介绍了6个利用ADS进行射频电路设计与仿真的实例,包括功率分配器、射频滤波器、低噪声放大器、混频器、压控振荡器和收发机。
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其它有用资料:《ADS2009射频电路设计与仿真》范例part1:http://download.csdn.net/source/3327661part2:http://download.csdn.net/source/3327724Agilent提供ADS2009自由下载,不用注册,并可申请试用license,地址在http://www.home.agilent.com/agilent/download.jspx?cc=US&lc=eng&nid=-34346.870777&pageMode=DL
2024/5/15 2:14:08 38.51MB ADS RF RRID 仿真
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大二所制渣作
2024/4/19 5:28:53 1.15MB 压控振荡器
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ADS_RFIC方案试验教程(台湾交大),内容搜罗:LNA/宽带放大器/差分吉尔伯特下变频器/正交压控振荡器等方案。
2023/4/7 17:03:43 3.03MB 射频/微波
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锁相的意义是相位同步的自动控制,能够完成两个电信号相位同步的自动控制闭环系统叫做锁相环,简称PLL。
它广泛应用于广播通信、频率合成、自动控制及时钟同步等技术领域。
锁相环主要由相位比较器(PC)、压控振荡器(VCO)。
低通滤波器三部分组成,如图1所示。
  压控振荡器的输出Uo接至相位比较器的一个输入端,其输出频率的高低由低通滤波器上建立起来的平均电压Ud大小决定。
施加于相位比较器另一个输入端的外部输入信号Ui与来自压控振荡器的输出信号Uo相比较,比较结果产生的误差输出电压UΨ正比于Ui和Uo两个信号的相位差,经过低通滤波器滤除高频分量后,得到一个平均值电压Ud。
这个平均值电压Ud朝着减小VCO输
2023/3/8 17:16:08 105KB
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奈奎斯特型锁相环,压控振荡器,环路滤波器,鉴相器,DDS
2023/2/16 22:40:45 885B PLL
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2015/11/21 4:57:46 4.31MB cadence
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分频器FD,压控振荡器VCO,PFD的verilogA模子用于Cadance仿真
2020/3/20 20:06:17 17KB FD VCO PFD VerilogA
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第1章是简短的引言,介绍锁相环领域的情况。
第2章安排涉及混合信号锁相环的理论,设计和混合信号PLL的应用。
讨论了不同类型的鉴相器(线性的和数字的),具有电荷泵输出的鉴频鉴相器、环路滤波器(无源和有源)以及压控振荡器
给出了典型混合信号锁相环的应用,例如重定时和时钟恢复,控制马达速度等。
因为频率综合器是DPLL数字锁相环最重要的应用之一,所以单立第3章深入讨论数字锁相环频率综合器。
因为相位抖动和寄生边带是频率综合器最烦人的现象,我们给出了不同的解决这些问题的方法,即抗齿隙式电路和高阶环路滤波器。
此外,还分析了整数N和分数N两类综合器并说明后者可以非常快地捕获锁定,其特点是在跳频(扩频)应用中具有很大的好处;
最新一代的移动电话中,扩频技术将越来越重要。
接着说明了简单的频率综合器可以单环实现,而高功能系统中必须使用多环结构。
2022/9/4 5:00:44 18.04MB 锁相环设计
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一种基于数字可控电感的宽带压控振荡器
2022/9/3 5:58:37 1.32MB 研究论文
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在日常工作中,钉钉打卡成了我生活中不可或缺的一部分。然而,有时候这个看似简单的任务却给我带来了不少烦恼。 每天早晚,我总是得牢记打开钉钉应用,点击"工作台",再找到"考勤打卡"进行签到。有时候因为工作忙碌,会忘记打卡,导致考勤异常,影响当月的工作评价。而且,由于我使用的是苹果手机,有时候系统更新后,钉钉的某些功能会出现异常,使得打卡变得更加麻烦。 另外,我的家人使用的是安卓手机,他们也经常抱怨钉钉打卡的繁琐。尤其是对于那些不太熟悉手机操作的长辈来说,每次打卡都是一次挑战。他们总是担心自己会操作失误,导致打卡失败。 为了解决这些烦恼,我开始思考是否可以通过编写一个全自动化脚本来实现钉钉打卡。经过一段时间的摸索和学习,我终于成功编写出了一个适用于苹果和安卓系统的钉钉打卡脚本。
2024-04-09 15:03 15KB 钉钉 钉钉打卡