LPM_ROM和LPM_RAM设计一实验目的掌握FPGA中LPM_ROM的设置：1作为只读寄存器ROM的工作特性和配置方法；
2学习将程序代码或数据以MIF格式文件加载于LPM_ROM中；
掌握lpm_ram_dp的参数设置和使用方法：1掌握lpm_ram_dp作为随即存储器RAM的设置；
2掌握lpm_ram_dp的工作特性和读写方法；
3掌握lpm_ram_dp的仿真测试方法。
二实验要求1LPM_ROM定制和测试LPM_ROM的参数设置：LPM_ROM中数据的写入，即初始化文件的编写；
LPM_ROM的实际应用，在GW48实验台上用N0.0电路模式测试。
2LPM_RAM定制和测试LPM_RAM的参数设置；
LPM_RAM的实际应用，在GW48实验台上用N0.0电路模式测试。
三实验原理用户可编程硬件FPGA芯片设计，有许多可调用参数化库模块LPM（LibraryParameterizedModules）,课直接调用设置，利用嵌入式阵列块EAB（EmbedArrayBlock）构成lpm_ROM，lpm_RAM等各种存储器结构。
Lpm_ROM有5组信号：地执信号address[]；
数据信号q[];时钟信号inclock、outclock;允许信号memenable.其参数是可以设定的。
由于ROM是只读寄存器，它的数据口试单向的输出端口，数据是在对FPGA现场配置时，通过配置文件一起写入存储单元的。
Lpm_ram_dq的输入/输出信号如下：地址信号address[];RAM_dqo的存储单元地址；
数据输入信号DATA[]RAM_dqo的数据输入端；
数据输出信号Q[]；
RAM_dqo的数据输出端；
时钟信号CLK;读/写时钟脉冲信号；
读写信号W/R读/写控制信号端数据从总线端口DATA[]输入。
丹输入数据和地址准备好以后，由于在inclock上的信号是地址锁存时钟，当信号上升沿到来时，地址被锁存，于是数据被写入存储单元。
数据的读出控制是从A[]输入存储单元地址，在CLK信号上升沿到来时，该单元数据从Q[]输出。
W/R为读/写控制端，低电平时进行读操作，高电平时进行写操作；
四实验步骤

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CreateReactApp入门该项目是通过引导的。
可用脚本在项目目录中，可以运行：npmstart在开发模式下运行应用程序。
打开在浏览器中查看它。
如果您进行编辑，则页面将重新加载。
您还将在控制台中看到任何棉绒错误。
npmtest在交互式监视模式下启动测试运行器。
有关更多信息，请参见关于的部分。
npmrunbuild构建生产到应用程序build文件夹。
它在生产模式下正确捆绑了React，并优化了构建以获得最佳性能。
生成被最小化，并且文件名包括哈希值。
您的应用已准备好进行部署！有关更多信息，请参见关于的部分。
npmruneject注意：这是单向操作。
eject，您将无法返回！如果您对构建工具和配置选择不满意，则可以随时eject。
此命令将从您的项目中删除单个生成依赖项。
相反，它将所有配置文件和传递依赖项（we

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今日写了一个ViewPager和Fragment配合使用，达到ViewPager不设置预加载（也就是一次只加载一个）和Fragment懒加载（也就是只加载一次）。
通俗的说就是滑动或点击哪个便加载哪个，并且加载过的不再加载。

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基本功能：1：支持16进制数据发送与接收。
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3：自动加载对应操作系统串口号。
4：实时显示收发数据字节大小以及串口状态。
高级功能：1：可自由管理需要发送的数据，每次只要从下拉框中选择数据即可，无需重新输入数据。
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当接收到设置好的指令时，立即回复设置的回复指令。
例如指定收到0x160x000xFF0x01需要回复0x160x000xFE0x01，则只需要在SendData.txt中添加一条数据1600FF01:1600FE01即可。
3：可定时发送数据和保存数据到文本文件:，默认间隔5秒钟，可更改间隔时间。
4：在不断接收到大量数据时，可以暂停显示数据来查看具体数据，后台依然接收数据但不处理，无需关闭串口来查看已接收到的数据。
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