基于Xilinx的AC701开发板编写的Verilog程序,使用FPGA实现以太网UDP通信,主程序是ac701_ethernet_comm.v,其中的IP核请自行例化。
2023/8/21 2:50:25 40KB FPGA UDP AC701 网络通信
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基于Verilog代码和调用IP核的ROM模块存储波形,实现基于FPGA的正弦波信号输出以及波形的仿真
2023/6/29 22:12:47 2.54MB 正弦波
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modelsim-win64-2019.2-se是最新一款Mentor公司推出的专业的HDL语言仿真软件,提供强大的仿真环境,是业界唯一的单内核支持VHDL和Verilog混合仿真的仿真器。
Modelsim全面支持VHDL和Verilog语言的IEEE标准,支持C/C++功能调用,并采用直接优化的编译技术、Tcl/Tk技术、和单一内核仿真技术,编译仿真速度快,编译的代码与平台无关,便于保护IP核,个性化的图形界面和用户接口,为用户加快调错提供强有力的手段,是FPGA/ASIC设计的首选仿真软件。
2023/5/17 8:29:06 141B modelsim
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《Xilinx系列FPGA芯片IP核详解》残缺版。
550页PDF格式。
刘东华。
FPGA的IP核详解书籍。

FIFO使用,
2023/5/6 2:41:52 139.18MB FPGA XILINX IP
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quartus软件齐全IP核的license,开拓quartusIP核必备。
2023/5/2 19:53:06 86KB IP核license
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本材料详细描述如何用FPGA完成以太网IP核,包括文档和FPGA代码
2023/3/9 12:42:20 825KB FPGA 以太网
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快速傅立叶变换(FFT)作为时域和频域转换的基本运算,是数字谱分析的必要前提。
传统的FFT使用软件或DSP实现,高速处理时实时性较难满足。
FPGA是直接由硬件实现的,其内部结构规则简单,通常可以容纳很多相同的运算单元,因而FPGA在作指定运算时,速度会远远高于通用的DSP芯片。
FFT运算结构相对比较简单和固定,适于用FPGA进行硬件实现,并且能兼顾速度及灵活性。
本文介绍了一种通用的可以在FPGA上实现32点FFT变换的方法。
2023/3/4 19:51:44 8.08MB fpga 傅里叶变换(FFT)IP核
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针对Win8/Win8.1/Win10中,Vivado例化MIG核时报错退出的情况,笔者在此为大家提供一个DDR的模板工程。
此工程目标开发板是Nexys4DDR,并且已经包含相应的DDR2IP核。
各位可以根据实际使用需要更改参数或者例化DDR3、LPDDR2的IP核。
2023/2/12 18:16:15 64.88MB Xilinx Vivado DDR
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开发板是DigilentNexys_Video开发板,程序的基础是误点原子为其FPGA产品提供的驱动程序,由于板子硬件的不同,做了一些改动,使之能在Nexys_Video上运行。
HDMI驱动用的是Digilent提供的IP核vivado版本2018.1
2023/2/12 10:40:03 45.58MB NEXYS_VIDEO FPGA
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VGA表现IP核(包括驱动).7z
2023/2/9 4:43:08 32KB fpga
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在日常工作中,钉钉打卡成了我生活中不可或缺的一部分。然而,有时候这个看似简单的任务却给我带来了不少烦恼。 每天早晚,我总是得牢记打开钉钉应用,点击"工作台",再找到"考勤打卡"进行签到。有时候因为工作忙碌,会忘记打卡,导致考勤异常,影响当月的工作评价。而且,由于我使用的是苹果手机,有时候系统更新后,钉钉的某些功能会出现异常,使得打卡变得更加麻烦。 另外,我的家人使用的是安卓手机,他们也经常抱怨钉钉打卡的繁琐。尤其是对于那些不太熟悉手机操作的长辈来说,每次打卡都是一次挑战。他们总是担心自己会操作失误,导致打卡失败。 为了解决这些烦恼,我开始思考是否可以通过编写一个全自动化脚本来实现钉钉打卡。经过一段时间的摸索和学习,我终于成功编写出了一个适用于苹果和安卓系统的钉钉打卡脚本。
2024-04-09 15:03 15KB 钉钉 钉钉打卡