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/ 浮点数乘法器,verilog
浮点数乘法器,verilog
上传者:
zj635315280
|
上传时间:2018/4/2 17:44:09
|
文件大小:3KB
|
文件类型:v
浮点数乘法器
verilog
FPGA
浮点数乘法器,verilog
浮点数乘法器,verilog,可间接综合
本软件ID:
6686867
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-硬件开发
评论信息
Pumpkin谢:
没有太大价值
2020-03-18
sun+coder:
没价值的文档
2019-01-02
a12322a:
下下来看看
2018-01-26
baiyvwei:
花了3积分下了一个已经有的文件。。。。。
2017-11-17
brotherzhao:
挺好的资源,但是里面直接用乘法器对尾数进行处理。。。。。。这样的话这个就变成了调用定点乘法器进行浮点运算了,对浮点数的格式处理有一定参考价值
2017-06-28
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