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ARM高速缓存(Cache)Verilog代码包含ISE工程

上传者: zdinanyang | 上传时间:2024/4/12 2:12:30 | 文件大小:2.6MB | 文件类型:zip
ARM高速缓存(Cache)Verilog代码包含ISE工程
该工程包含数据缓存D_Cache和指令缓存I_Cache的Verilog代码和仿真文件,附带可运行的ISE工程文件,Cache的详细技术参数包含在.v文件的注释中。
直接相连16KBD_CacheCache写策略:写回法+写分配(二路)组相连16KBI_CacheCache替换策略: LRUI_Cache的工作就是在cpu需要指令时将指令从主存中搬进I_Cache,再传给CPU,而D_Cache在解决数据读外,还要注意数据写入的问题。
本工程可以与arm.v中的arm核协同工作,主存使用dram_ctrl_sim。

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评论信息

  • ncf25:
    不是特别完整2021-03-02
  • ncf25:
    不是特别完整2021-03-02
  • xiaochengxs:
    学习学习,希望有用。。。。。。2019-06-27
  • XiaoChengxs:
    学习学习,希望有用。。。。。。2019-06-27
  • tianshan2017:
    不错,先下来学习2017-06-11
  • tianshan2017:
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  • u012764338:
    参考学习,有帮助,帮助了解一下概念2016-09-23
  • 狂奔的蜗牛_001:
    参考学习,有帮助,帮助了解一下概念2016-09-23
  • github_35228459:
    挺不错的资料,谢谢分享.2016-06-05
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