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FPGA串口8位转32位收发数据

上传者: weixin_40365277 | 上传时间:2022/10/12 9:34:37 | 文件大小:983KB | 文件类型:zip
verilog xilinx fpga 1Om8hQjGYN
FPGA串口8位转32位收发数据
此为FPGA串口8转32位收发数据,笔者亲测可用,接收与发送数据都进行了32位的转化,希望可以协助到有需要的朋友们

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评论信息

  • 小五头:
    我想接收24位。改一改就可以了吧2020-07-26
  • lj-TL:
    很棒,程序正确无误,串口这个其实简单,就是烦,容易出错!2020-05-28
  • Kaneluke:
    极好的资源,不知道楼上为何说是空白,作者是把工程都放进去了,有个pll的IP核,可以忽略,找到verilog文件,如果有100MHz时钟就可以直接用了,如果是小时钟,自己用quartusII或者viv2019-02-15
  • 「已注销」:
    什么都没,空白的2018-11-19

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