/ 基于FPGA分布式算法FIR滤波器verilog代码
基于FPGA分布式算法FIR滤波器verilog代码
基于FPGA分布式算法FIR滤波器verilog代码
（本人小论文代码，通过验证）本文提出一种新的FIR滤波器FPGA实现方法。
讨论了分布式算法原理，并提出了基于分布式算法FIR滤波器的实现方法。
通过改进型分布式算法结构减少硬件资源消耗，用流水线技术提高运算速度，采用分割查找表方法减小存储规模，并在Matlab和Modelsim仿真平台得到验证。
为了节省FPGA逻辑资源、提高系统速度，设计中引入了分布式算法实现有限脉冲响应滤波器(FiniteImpulseResponse,FIR)。
由于FIR滤波器在实现上主要是完成乘累加MAC的功能，采用传统MAC算法设计FIR滤波器将消耗大量硬件资源。
而采用分布式算法(DistributedArithmetic,DA)，将MAC运算转化为查找表(Look-Up-Table,LUT)输出，不仅能在硬件规模上得到改善，而且更易通过实现流水线设计来提高速度。
因此本文采用分布式算法设计一个可配置的FIR滤波器，并以31阶的低通FIR滤波器为例说明分布式算法滤波器结构。
本软件ID:5342615
（本人小论文代码，通过验证）本文提出一种新的FIR滤波器FPGA实现方法。
讨论了分布式算法原理，并提出了基于分布式算法FIR滤波器的实现方法。
通过改进型分布式算法结构减少硬件资源消耗，用流水线技术提高运算速度，采用分割查找表方法减小存储规模，并在Matlab和Modelsim仿真平台得到验证。
为了节省FPGA逻辑资源、提高系统速度，设计中引入了分布式算法实现有限脉冲响应滤波器(FiniteImpulseResponse,FIR)。
由于FIR滤波器在实现上主要是完成乘累加MAC的功能，采用传统MAC算法设计FIR滤波器将消耗大量硬件资源。
而采用分布式算法(DistributedArithmetic,DA)，将MAC运算转化为查找表(Look-Up-Table,LUT)输出，不仅能在硬件规模上得到改善，而且更易通过实现流水线设计来提高速度。
因此本文采用分布式算法设计一个可配置的FIR滤波器，并以31阶的低通FIR滤波器为例说明分布式算法滤波器结构。
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评论信息
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tbsk7842:没用到，(｡･∀･)ﾉﾞ嗨2019-12-12 -
yuzhang0128:可以，代码可以，能过2019-03-05
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nightmare1087:很一般，并不适用2018-11-02
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WYS1211:仿真有问题，并没有起到滤波的效果，一堆噪声2018-04-15
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qq_38763544:不错总体还好2018-03-17
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