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按键计数器+按键去抖(VerilogHDL)

上传者: qq_28662831 | 上传时间:2024/7/27 11:37:03 | 文件大小:3.01MB | 文件类型:rar
按键计数器+按键去抖(VerilogHDL)
基于Quartus13.0的EDA实验程序,1.设计一个10进制计数器,用七段数码管显示计数器的数值,以开发板上1个按键作为计数器的时钟输入,按键每按动一次,相当于产生“一个时钟脉冲”,观察开关抖动情况。
2.设计一个去抖电路,按键信号经去抖以后再作为计数器的时钟输入,观察去抖效果。

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评论信息

  • 周呀周:
    还没下载先看看2018-10-17

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