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基于fpga的ppm位同步verilog代码

上传者: assassin51 | 上传时间:2020/6/10 12:04:19 | 文件大小:3KB | 文件类型:zip
基于fpga的ppm位同步verilog代码
基于fpga的ppm位同步verilog代码采用锁相环同步分为4部分,明晰明了,高频时钟为8倍频

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[{"title":"(5个子文件3KB)基于fpga的ppm位同步verilog代码","children":[{"title":"Loop_Filter.v <span style='color:#111;'>2.93KB</span>","children":null,"spread":false},{"title":"Num_creat.v <span style='color:#111;'>370B</span>","children":null,"spread":false},{"title":"phase_detector.v <span style='color:#111;'>2.86KB</span>","children":null,"spread":false},{"title":"bit_synchronize.v <span style='color:#111;'>718B</span>","children":null,"spread":false},{"title":"clock_devide.v <span style='color:#111;'>825B</span>","children":null,"spread":false}],"spread":true}]

评论信息

  • qq_28619031:
    编译成功,不过还是先了解原理比较好2017-12-13
  • qq_28619031:
    编译成功,不过还是先了解原理比较好2017-12-13
  • youyoubishui:
    仿真波形可以实现,注意仿真的时候8倍频,但是目前暂时还没有看懂他的设计流程,没有注释看起来比较麻烦~2015-10-17
  • youyoubishui:
    仿真波形可以实现,注意仿真的时候8倍频,但是目前暂时还没有看懂他的设计流程,没有注释看起来比较麻烦~2015-10-17
  • qq_27544037:
    代码编译成功,但是没有注释,看起来很费力!2015-09-01
  • 城之一隅:
    代码编译成功,但是没有注释,看起来很费力!2015-09-01
  • chenhuyu:
    锁相环同步的方法,好像还有不用锁相环的方法。2015-04-07
  • chenhuyu:
    锁相环同步的方法,好像还有不用锁相环的方法。2015-04-07
  • u013685994:
    很好的东西,感谢分享!2014-10-10
  • shao0285:
    很好的东西,感谢分享!2014-10-10

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