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/ 基于verilog言语实现的SDRAM控制器设计(含源代码)
基于verilog言语实现的SDRAM控制器设计(含源代码)
上传者:
aliang8708
|
上传时间:2021/1/16 8:17:10
|
文件大小:4.14MB
|
文件类型:doc
SDRAM控制器
verilog
FPGA
基于verilog言语实现的SDRAM控制器设计(含源代码)
基于verilog言语实现的SDRAM控制器设计(含源代码)
本软件ID:
5326497
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log语言实现的SDRAM控制器设计(含源代码)-cite-
评论信息
weixin_42209598:
还可以看看
2018-05-15
sinat_17759331:
还好,挺有用的
2014-08-07
myy988927:
还好,可以作为后续学习的参考
2014-07-11
wanli2011:
很难,看了资料都不一定有用
2014-06-08
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