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verilog电子表设计

上传者: adszl | 上传时间:2023/11/15 17:07:10 | 文件大小:689KB | 文件类型:rar
verilog电子表设计
使用verilog设计一个电子时钟,基于xilinx开发板,可实现数码管的显示,调时等功能

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评论信息

  • lwzq521:
    在我完成课程设计的过程中,起了很大的作用!谢谢楼主啦2013-12-28
  • mymymy42:
    对现在的课程的设计很有帮助2013-07-01
  • dlj292006:
    和我要做的不一样,我是用cpld2013-04-05

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