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ca码生成(verilog)

CA码 verilog fpga quartusII

ca码生成(verilog)
用verilog写的一个ca码的生成代码，内含quartusII的仿真文件（波形和testbench）。
本软件ID:7341587

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[{"title":"（4个子文件3KB）ca码生成(verilog)","children":[{"title":"C_A.vwf 12.17KB","children":null,"spread":false},{"title":"C_A.qpf 1.25KB","children":null,"spread":false},{"title":"C_A.v 602B","children":null,"spread":false},{"title":"C_A.vt 3.01KB","children":null,"spread":false}],"spread":true}]

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北方爷们:

垃圾，抄的别人的2020-03-15
clchengll:

还没使用，希望有代码中有源文件2019-10-27

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