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EDA四人抢答器Verilog编程

上传者: wtm_dxyb | 上传时间:2022/10/31 16:08:17 | 文件大小:2.09MB | 文件类型:rar
EDA四人抢答器Verilog编程
①用EDA实训仪的I/O设备和PLD芯片实现智能电子抢答器的计。
②智能电子抢答器可容纳4组参赛者抢答,每组设一个抢答钮。
③电路具有第一抢答信号的鉴别和锁存功能。
在掌管人将复位按钮按下后开始抢答,并用EDA实训仪上的八段数码管显示抢答者的序号,同时扬声器发出“嘟嘟”的响声,并维持3秒钟,此时电路自锁,不再接受其他选手的抢答信号。
④设计一个计分电路,每组在开始时设置为100分,抢答后由掌管人计分,答对一次加10分,答错一次减10分。
⑤设计一个犯规电路,对提前抢答和超时抢答者鸣喇叭示警,并显示犯规的组别序号。
本软件ID:2842108

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评论信息

  • J_Hang:
    打不开。。。。2020-12-06
  • 布拉格的平行世界:
    这个打不开啊2020-11-26
  • Versezz:
    能有大神解释一下吗2017-06-12
  • qq_17512297:
    确实还可以,用了一下挺好用的2015-09-18
  • zzzzyyang:
    做的真的很好!!非常感谢啊下了好几个Verilog的这个最好了2015-07-25

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