/ 基于全加器的逻辑判别电路设计
基于全加器的逻辑判别电路设计
基于全加器的逻辑判别电路设计
全加器是实现算术加法运算的基本器件，常规使用是构成1位或多位二进制数算术加法运算电路。
本文探讨了对全加器进行逻辑功能扩展的方法，目的是探索全加器进行非常规使用改变使用方向的逻辑设计技术，即用多个一位全加器组合、连接构成对多个输入量算术加运算电路，输入变量中1的个数不同，相加的结果也就不同，在相加结果的基础上再进行多数表决、奇偶数判别等逻辑判别电路的设计。
所述方法的创新点是提出了全加器改变使用方向的逻辑设计方法。
本软件ID:14951982
全加器是实现算术加法运算的基本器件，常规使用是构成1位或多位二进制数算术加法运算电路。
本文探讨了对全加器进行逻辑功能扩展的方法，目的是探索全加器进行非常规使用改变使用方向的逻辑设计技术，即用多个一位全加器组合、连接构成对多个输入量算术加运算电路，输入变量中1的个数不同，相加的结果也就不同，在相加结果的基础上再进行多数表决、奇偶数判别等逻辑判别电路的设计。
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