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蜂鸣器verilog
蜂鸣器verilog
用verilog抑制蜂鸣器发声modulefp_verilog(out,clk);outputout;inputclk;reg[13:0]cn;regout;always@(posedgeclk)begincn＜=cn+1'b1;if(cn==14'd12000)begincn＜=14'd0;out＜=~out;endendendmodule 本软件ID:4805585
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lichen14:只有一个.v文件。。。。不推荐下载2017-06-12 -
logilas:不太清楚何如控制的，是高低变化吗？2015-07-28
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