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基于FPGA的通用可控分频器的设计

上传者: seaeastlee | 上传时间:2024/5/26 1:17:57 | 文件大小:2.81MB | 文件类型:rar
基于FPGA的通用可控分频器的设计
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基于FPGA的分频器设计1)系统时钟1MHz;
2)要求能产生2分频~16分频信号,分频系数步进值为1;
3)“分频系数置数”按钮每按一次,分频系数增加1,增加到16后如果再次按下“分频系数置数”按钮,分频系数回归到2;
置数结束后,按下“启动”按钮,系统按照指定的分频系数生成分频信号;
4)n分频后,“1”电平持续的时间要求1~n-1可调,步进值1;
5)“占空系数置数”按钮每按一次,“1”电平持续时间增加1,增加到n-1后如果再次按下“分频系数置数”按钮,“1”电平持续时间回归到1;
再按下“启动”按钮后,系统按照指定的“1”电平持续时间生成分频信号;

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