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基于FPGA的闹钟系统设计
上传者:
mu7xuan
|
上传时间:2017/2/27 3:41:56
|
文件大小:2.71MB
|
文件类型:doc
FPGA,EDA,VHDL语言,数字时钟设计
基于FPGA的闹钟系统设计
本文就是用VHDL语言来描述一个基于FPGA的数字闹钟系统的设计。
该数字闹钟系统具备精确计时,时间校准,定时闹钟等功能。
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资源详情
-专业指导
评论信息
robertbrown123:
不错,稍微改一改可以直接当课程设计交上去了
2015-04-06
hanxuaner:
我觉得非常不错啊,很实用的报告。
2014-01-13
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